- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄370468 > HD6433437TF12 (Hitachi,Ltd.) 12 V must not be applied to the S-mask model (single-power-supply specification), as this may permanently damage the device. PDF資料下載
參數(shù)資料
| 型號： | HD6433437TF12 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | 12 V must not be applied to the S-mask model (single-power-supply specification), as this may permanently damage the device. |
| 中文描述： | 12伏不能適用的S -面具模型（單電源規(guī)范），因為這可能會永久損壞設(shè)備。 |
| 文件頁數(shù)： | 23/752頁 |
| 文件大?。?/td> | 2656K |
| 代理商： | HD6433437TF12 |
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viii
Section 15 A/D Converter
.................................................................................................. 335
15.1 Overview............................................................................................................................ 335
15.1.1 Features................................................................................................................. 335
15.1.2 Block Diagram...................................................................................................... 336
15.1.3 Input Pins.............................................................................................................. 337
15.1.4 Register Configuration.......................................................................................... 338
15.2 Register Descriptions......................................................................................................... 339
15.2.1 A/D Data Registers A to D (ADDRA to ADDRD).............................................. 339
15.2.2 A/D Control/Status Register (ADCSR)................................................................ 340
15.2.3 A/D Control Register (ADCR)............................................................................. 342
15.3 CPU Interface..................................................................................................................... 342
15.4 Operation............................................................................................................................ 344
15.4.1 Single Mode (SCAN = 0) ..................................................................................... 344
15.4.2 Scan Mode (SCAN = 1)........................................................................................ 346
15.4.3 Input Sampling and A/D Conversion Time.......................................................... 348
15.4.4 External Trigger Input Timing.............................................................................. 349
15.5 Interrupts............................................................................................................................ 350
15.6 Application Notes.............................................................................................................. 350
Section 16 D/A Converter
.................................................................................................. 355
16.1 Overview............................................................................................................................ 355
16.1.1 Features................................................................................................................. 355
16.1.2 Block Diagram...................................................................................................... 356
16.1.3 Input and Output Pins........................................................................................... 357
16.1.4 Register Configuration............................................................................................ 357
16.2 Register Descriptions......................................................................................................... 358
16.2.1 D/A Data Registers 0 and 1 (DADR0, DADR1).................................................. 358
16.2.2 D/A Control Register (DACR)............................................................................. 358
16.3 Operation............................................................................................................................ 360
Section 17 RAM
.................................................................................................................... 361
17.1 Overview............................................................................................................................ 361
17.1.1 Block Diagram...................................................................................................... 361
17.1.2 RAM Enable Bit (RAME) in System Control Register (SYSCR) ....................... 362
17.2 Operation............................................................................................................................ 362
17.2.1 Expanded Modes (Modes 1 and 2)....................................................................... 362
17.2.2 Single-Chip Mode (Mode 3)................................................................................. 362
Section 18 ROM (Mask ROM Version/ZTAT Version)
.......................................... 363
18.1 Overview............................................................................................................................ 363
18.1.1 Block Diagram...................................................................................................... 364
18.2 Writer Mode (H8/3437, H8/3434)..................................................................................... 364
18.2.1 Writer Mode Setup................................................................................................ 364
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PDF描述 |
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