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參數(shù)資料
| 型號： | HD6433936R |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Hardware Manual |
| 中文描述： | 硬件手冊 |
| 文件頁數(shù)： | 354/521頁 |
| 文件大小： | 1507K |
| 代理商： | HD6433936R |
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342
OFD
1
OFD
0
0
Frequency Difference
0
+/- 300 ppm
0
1
+/- 150 ppm
1
0
+/- 75 ppm
1
1
+/- 0 ppm
PCE:
Partial Correlation Enable. When this bit is set, partial correlation of addresses is enabled.
When partial correlation is enabled, the FLEX decoder will shutdown the receiver before the end
of the last FLEX block which contains addresses if it can determine that none of the addresses in
that FLEX block will match any enabled address in the FLEX decoder. When this bit is cleared,
the receiver will be controlled as it was in previous versions of the FLEX decoder. (value after
reset=0)
SP:
Signal Polarity. These bits set the polarity of EXTS1 and EXTS0 input signals. (value after
reset=0) The polarity of the EXTS0 and EXTS1 bits will be determined by the receiver design.
Signal Polarity
SP
1
SP
0
0
EXTS1
EXTS0
0
Normal
Normal
0
1
Normal
Inverted
1
0
Inverted
Normal
1
1
Inverted
Inverted
FSK Modulation
@ SP = 0,0
EXTS1
EXTS0
+ 4800 Hz
1
0
+1600 Hz
1
1
- 1600 Hz
0
1
- 4800 Hz
0
0
SME:
Synchronous Mode Enable. When this bit is set, a Status Packet will be automatically sent
whenever the SMU (synchronous mode update) bit in the Status Packet is set. The host can use the
SM (synchronous mode) bit in the Status Packet as an in-range/out-of-range indication. (value
after reset=0)
MOT:
Maximum Off Time. This bit has no effect if AST in the Timing Control Packet is non-
ero. When ST=0 and MOT=0, asynchronous A-word searches will time-out in 4 minutes. When
ST=0 and MOT=1, asynchronous A-word searches will time-out in 1 minute. (value after
reset=0)
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