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參數(shù)資料
| 型號： | HD6435348SF |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Single-Chip Microcomputer |
| 中文描述： | 單片機(jī) |
| 文件頁數(shù)： | 233/487頁 |
| 文件大小： | 1408K |
| 代理商： | HD6435348SF |
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Bit 7—Compare-Match Interrupt Enable B (CMIEB):
This bit selects whether to request
compare-match interrupt B (CMIB) when compare-match flag B (CMFB) in the timer
status/control register (TCSR) is set to 1.
Bit 7
CMIEB
0
1
Description
Compare-match interrupt request B (CMIB) is disabled.
Compare-match interrupt request B (CMIB) is enabled.
(Initial value)
Bit 6—Compare-Match Interrupt Enable A (CMIEA):
This bit selects whether to request
compare-match interrupt A (CMIA) when compare-match flag A (CMFA) in the timer
status/control register (TCSR) is set to 1.
Bit 6
CMIEA
0
1
Description
Compare-match interrupt request A (CMIA) is disabled.
Compare-match interrupt request A (CMIA) is enabled.
(Initial value)
Bit 5—Timer Overflow Interrupt Enable (OVIE):
This bit selects whether to request a timer
overflow interrupt (OVI) when the overflow flag (OVF) in the timer status/control register
(TCSR) is set to 1.
Bit 5
OVIE
0
1
Description
The timer overflow interrupt request (OVI) is disabled.
The timer overflow interrupt request (OVI) is enabled.
(Initial value)
Bits 4 and 3—Counter Clear 1 and 0 (CCLR1 and CCLR0):
These bits select how the timer
counter is cleared: by compare-match A or B or by an external reset input.
Bit 4
CCLR1
0
0
1
1
Bit 3
CCLR0
0
1
0
1
Description
Not cleared.
Cleared on compare-match A.
Cleared on compare-match B.
Cleared on rising edge of external reset input signal.
(Initial value)
217
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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