參數(shù)資料
型號: HM5225325F-B60
廠商: Hitachi,Ltd.
英文描述: 256M LVTTL interface SDRAM 100 MHz 1-Mword x 64-bit x 4-bank/2-Mword x 32-bit x 4-bank PC/100 SDRAM
中文描述: 256M LVTTL接口SDRAM的100兆赫1 - Mword × 64位× 4-bank/2-Mword × 32位× 4個銀行PC/100 SDRAM的
文件頁數(shù): 16/16頁
文件大?。?/td> 81K
代理商: HM5225325F-B60
HM5225645F-B60, HM5225325F-B60
16
Revision Record
Rev. Date
Contents of Modification
Drawn by
Approved by
0.0
Feb. 1, 1999
Initial issue
S. Hatano
S. Hatano
0.1
Feb. 19, 1999 Pin arrangement
Correct pin No. to JEDEC standard
Package dimenssion
Correct illustration and indexes
S. Hatano
S. Hatano
0.2
Apr. 1, 1999
Ordering information
Correct error of type No.
Programmable
CAS
latency: 3 to 2/3
Ordering information
Addition of note
Pin description
Addition of note 1
DC Characteristics (HM5225645F)
I
CC1
max (CL = 2): 280 mA to 200 mA
I
CC1
max (CL = 3): 300 mA to 220 mA
I
CC4
max (CL = 2): 280 mA to 220 mA
I
CC4
max (CL = 3): 360 mA to 270 mA
I
CC5
max: 460 mA to 380 mA
DC Characteristics (HM5225325F)
I
CC1
max (CL = 2): 260 mA to 180 mA
I
CC1
max (CL = 3): 280 mA to 200 mA
I
CC4
max (CL = 2): 260 mA to 200 mA
I
CC4
max (CL = 3): 320 mA to 250 mA
I
CC5
max: 460 mA to 380 mA
Capacitance
C
I1
max: 16 pF to 14 pF
C
I2
max: 20 pF to 14 pF
C
O
min: 4 pF to 3 pF
C
O
max: 6.5 pF to 5 pF
Package dimension
Change tolerance of height
S. Hatano
S. Hatano
1.0
Oct. 1, 1999
相關(guān)PDF資料
PDF描述
HM5225645F-B60 256M LVTTL interface SDRAM 100 MHz 1-Mword x 64-bit x 4-bank/2-Mword x 32-bit x 4-bank PC/100 SDRAM
HM5225325F 256-Mbit SDRAM(256M位同步RAM)
HM5225645F 256-Mbit SDRAM(256M位同步RAM)
HM5225405B 256M LVTTL interface SDRAM(256M LVTTL接口同步DRAM)
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