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參數(shù)資料
| 型號(hào)： | HM5259165BTD-75 |
| 廠商： | ELPIDA MEMORY INC |
| 元件分類： | DRAM |
| 英文描述： | 512M LVTTL interface SDRAM 133 MHz/100 MHz 8-Mword 】 16-bit 】 4-bank/16-Mword 】 8-bit 】 4-bank /32-Mword 】 4-bit 】 4-bank PC/133, PC/100 SDRAM |
| 中文描述： | 32M X 16 SYNCHRONOUS DRAM, 5.4 ns, PDSO54 |
| 封裝： | 0.400 INCH, PLASTIC, TSOP2-54 |
| 文件頁(yè)數(shù)： | 4/63頁(yè) |
| 文件大?。?/td> | 368K |
| 代理商： | HM5259165BTD-75 |
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HM5259165B/HM5259805B/HM5259405B-75/A6
Data Sheet E0118H10
4
Pin Arrangement
(HM5259805B)
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
V
SS
DQ7
V
SS
Q
NC
DQ6
V
CC
Q
NC
DQ5
V
SS
Q
NC
DQ4
V
CC
Q
NC
V
SS
NC
DQM
CLK
CKE
A12
A11
A9
A8
A7
A6
A5
A4
V
SS
V
CC
DQ0
V
CC
Q
NC
DQ1
V
SS
Q
NC
DQ2
V
CC
Q
NC
DQ3
V
SS
Q
NC
V
CC
NC
WE
CAS
RAS
CS
BA0
BA1
A10
A0
A1
A2
A3
V
CC
54-pin TSOP
(Top view)
Pin Description
Pin name
Function
Pin name
WE
Function
A0 to A12,
BA0, BA1
Address input
Write enable
Row address
Column address
Bank select address BA0/BA1 (BS)
A0 to A12
DQM
Input/output mask
A0 to A9, A11
CLK
Clock input
CKE
Clock enable
DQ0 to DQ7
CS
RAS
CAS
Data-input/output
V
CC
V
SS
V
CC
Q
V
SS
Q
NC
Power for internal circuit
Chip select
Ground for internal circuit
Row address strobe command
Power for DQ circuit
Column address strobe command
Ground for DQ circuit
No connection
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PDF描述 |
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