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參數(shù)資料
| 型號： | HM66AEB36104BP-50 |
| 英文描述： | HM66AEB36104/HM66AEB18204 HM66AEB9404 Datasheet |
| 中文描述： | HM66AEB36104/HM66AEB18204 HM66AEB9404數(shù)據(jù)表 |
| 文件頁數(shù)： | 16/32頁 |
| 文件大小： | 251K |
| 代理商： | HM66AEB36104BP-50 |
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HM66AEB36102/18202/9402
Rev.0.0, Dec. 2002, page 14 of 30
Notes: 1. Outputs are impedance-controlled. |I
OH
| = (V
DDQ
/2)/(RQ/5) for values of 175
≤
RQ
≤
350
.
2. Outputs are impedance-controlled. I
OL
= (V
DDQ
/2)/(RQ/5) for values of 175
≤
RQ
≤
350
.
3. AC load current is higher than the shown DC values. AC I/O curves are available upon request.
4. HSTL outputs meet JEDEC HSTL Class I and Class II standards.
5. Measured at V
OH
= V
DDQ
/2
6. Measured at V
OL
= V
DDQ
/2
7. Output buffer impedance can be programmed by terminating the ZQ ball to V
through a
precision resistor (RQ). The value of RQ is five times the output impedance desired. The
allowable range of RQ to guarantee impedance matching with a tolerance of 10% is 250
typical. The total external capacitance of ZQ ball must be less than 7.5 pF.
8. 0
≤
V
IN
≤
V
DDQ
for all input balls (except V
REF
, ZQ, TCK, TMS, TDI ball)
9. 0
≤
V
OUT
≤
V
DDQ
(except TDO ball), output disabled.
10. V
DDQ
= 1.5 V
±
0.1 V
Capacitance
(Ta = +25
°
C, f = 1.0 MHz, V
DD
= 1.8 V)
Parameter
Symbol Min
Typ
Max
Unit
Test conditions
Input capacitance
C
IN
C
CLK
C
I/O
4
5
pF
V
IN
= 0 V
V
CLK
= 0 V
V
I/O
= 0 V
Clock input capacitance
5
6
pF
Input/output capacitance (DQ)
Notes: 1. These parameters are sampled and not 100% tested.
2. Parameters tested with RQ = 250
and V
DDQ
= 1.5 V.
6
7
pF
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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