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參數(shù)資料
| 型號： | ICS271PGILFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 4/11頁 |
| 文件大小： | 0K |
| 描述： | VCXO CLK TRPL PLL PROGR 20-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | VersaClock™ |
| 類型： | 時鐘/頻率合成器，扇出緩沖器（分配） |
| PLL： | 帶旁路 |
| 輸入： | 晶體 |
| 輸出： | CMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:6 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 200MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 20-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 271PGILFT |
ICS271
TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER
EPROM VCXO AND SYNTHESIZER
IDT / ICS TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER 2
ICS271
REV E 051310
Pin Assignment
Pin Descriptions
13
4
12
5
11
VDD
8
9
10
GND
CLK2
CLK5
CLK1
CLK3
CLK6
17
16
VDDO2
3
S1
VIN
S2
18
PDTS
1
S0
VDD
20
X2
19
14
2
7
GND
VDDO1
VDD
CLK4
15
6
20 pin (173 mil) TSSOP
X1
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
VIN
Input
Voltage input to VCXO. Zero to 3.3 V signal which controls the VCXO
frequency
2
S0
Input
Select pin 0. Internal pull-up resistor.
3
S1
Input
Select pin 1. Internal pull-up resistor.
4VDD
Power
Connect to +3.3 V.
5
VDDO1
Power
Power supply for outputs CLK1-CLK3. Must not exceed VDD.
6
CLK1
Output
Output clock 1. Weak internal pull-down when tri-state.
7
CLK2
Output
Output clock 2. Weak internal pull-down when tri-state.
8
CLK3
Output
Output clock 3. Weak internal pull-down when tri-state.
9
GND
Power
Connect to ground.
10
X1
XI
Crystal input. Connect this pin to a crystal.
11
X2
XO
Crystal Output. Connect this pin to a crystal.
12
VDD
Power
Connect to +3.3 V.
13
VDDO2
Power
Power supply for outputs CLK4-CLK6. Must not exceed VDD.
14
CLK4
Output
Output clock 4. Weak internal pull-down when tri-state.
15
CLK5
Output
Output clock 5. Weak internal pull-down when tri-state.
16
CLK6
Output
Output clock 6. Weak internal pull-down when tri-state.
17
GND
Power
Connect to ground.
18
PDTS
Input
Power-down tri-state. Powers down entire chip and tri-states clock outputs
when low. Internal pull-up resistor.
19
VDD
Power
Connect to +3.3 V.
20
S2
Input
Select pin 2. Internal pull-up resistor.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ICS275 | 制造商:ICS 制造商全稱:ICS 功能描述:Triple PLL Field Programmable VCXO Clock Synthesizer |
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