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參數(shù)資料
| 型號(hào)： | ICS557G-06T |
| 元件分類(lèi)： | 時(shí)鐘及定時(shí) |
| 英文描述： | 557 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| 封裝： | 0.173 INCH, TSSOP-20 |
| 文件頁(yè)數(shù)： | 5/10頁(yè) |
| 文件大?。?/td> | 203K |
| 代理商： | ICS557G-06T |
MDS 557-06 C
4
Revision 010306
In te gr ated Circuit Systems ● 525 Ra ce Street, San Jose, CA 9512 6 ● tel (4 08) 297-1 201 ● www.icst.com
ICS557-06
One to Four HCSL Clock Buffer
Output Structures
General PCB Layout Recommendations
For optimum device performance and lowest output
phase noise, the following guidelines should be
observed.
1. Each 0.01F decoupling capacitor should be
mounted on the component side of the board as close
to the VDD pin as possible.
2. No vias should be used between decoupling
capacitor and VDD pin.
3. The PCB trace to VDD pin should be kept as short
as possible, as should the PCB trace to the ground via.
Distance of the ferrite bead and bulk decoupling from
the device is less critical.
4. An optimum layout is one with all components on the
same side of the board, minimizing vias through other
signal layers (any ferrite beads and bulk decoupling
capacitors can be mounted on the back). Other signal
traces should be routed away from the ICS557-06.This
includes signal traces just underneath the device, or on
layers adjacent to the ground plane layer used by the
device.
R
R 475
6*IREF
=2.3 mA
IREF
See Output Termination
Sections - Pages 3 ~ 5
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PDF描述 |
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