參數(shù)資料
型號: ICS570B
英文描述: Multiplier and Zero Delay Buffer
中文描述: 乘數(shù)和零延遲緩沖器
文件頁數(shù): 4/6頁
文件大?。?/td> 96K
代理商: ICS570B
ICS570B
Multiplier and Zero Delay Buffer
MDS 570B A
Integrated Circuit Systems, Inc . 525 Race Street San Jose CA 95126 (408)295-9800tel www.icst.com
4
Revision 053001
PRELIMINARY INFORMATION
Clock Period Jitter Tables
All jitter values are considered typical measured at 25°C with 27
series termination resistor and 15pF loads on
both CLK and CLK2. The feedback is from CLK2 to FBIN. Note that if an output is unused, it should be left
unconnected to improve output jitter on the active output clocks.
CLKIN
(MHz)
8.333
6.25
3.125
4.167
2.5
25
1.5625
12.5
CLK = 50M
MultiplierAbsolute 1 sigma
6x
±110
8x
±125
16x
±130
12x
±120
20x
±115
2x
±130
32x
±120
4x
±120
CLK/2 = 25M
Absolute
±55
±50
±55
±55
±55
±55
±55
±55
S1
0
0
M
M
M
1
1
1
S0
M
1
0
M
1
0
M
1
Multiplier
3x
4x
8x
6x
10x
1x
16x
2x
1 sigma
20
20
20
20
20
20
20
20
80
90
90
90
90
50
90
60
CLKIN
(MHz)
16.667
12.5
6.25
8.333
5
50
3.125
25
CLK = 100M
MultiplierAbsolute 1 sigma
6x
±100
8x
±100
16x
±110
12x
±100
20x
±105
2x
±90
32x
±95
4x
±105
CLK/2 = 50M
Absolute
±45
±45
±45
±45
±40
±40
±45
±60
S1
0
0
M
M
M
1
1
1
S0
M
1
0
M
1
0
M
1
Multiplier
3x
4x
8x
6x
10x
1x
16x
2x
1 sigma
20
20
20
20
20
20
20
30
70
70
80
70
70
60
70
70
CLKIN
(MHz)
25
18.375
9.375
12.5
7.5
75
4.6875
37.5
CLK = 150M
MultiplierAbsolute 1 sigma
6x
±115
8x
±120
16x
±130
12x
±130
20x
±130
2x
±115
32x
±130
4x
±110
CLK/2 = 75M
Absolute
±50
±50
±50
±45
±45
±45
±50
±60
S1
0
0
M
M
M
1
1
1
S0
M
1
0
M
1
0
M
1
Multiplier
3x
4x
8x
6x
10x
1x
16x
2x
1 sigma
20
20
20
20
20
20
20
20
70
80
90
90
90
90
90
70
Absolute and One Sigma Jitter (ps), VDD = 3.3V
Absolute and One Sigma Jitter (ps), VDD = 3.3V
Absolute and One Sigma Jitter (ps), VDD = 3.3V
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