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參數(shù)資料
| 型號(hào)： | ICS570M |
| 英文描述： | Multiplier and Zero Delay Buffer |
| 中文描述： | 乘數(shù)和零延遲緩沖器 |
| 文件頁(yè)數(shù)： | 5/6頁(yè) |
| 文件大小： | 85K |
| 代理商： | ICS570M |
ICS570A
Multiplier and Zero Delay Buffer
MDS 570A C
Integrated Circuit Systems, Inc . 525 Race Street San Jose CA 95126 (408)295-9800tel www.icst.com
5
Revision 102700
Printed 11/14/00
Recommended Circuit:
VDD
GND
INPUT
ICK
CLK
CLK/2
ICLK
CLK
CLK/2
x2 Mode (S1, S0 = 1, 1)
CLK Feedback
x2 Mode (S1, S0 = 1, 0)
CLK/2 Feedback
CLK
CLK/2
S1
S0
Using CLK as the feedback will always result in synchronized rising edges between ICLK and CLK. But the
CLK/2 could be a falling edge compared with ICLK. Therefore, wherever possible, we recommend the use of
CLK/2 feedback. This will synchronize the rising edges of all 3 clocks.
FBIN
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ICS570MIT | 制造商:ICS 制造商全稱:ICS 功能描述:Multiplier and Zero Delay Buffer |
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