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參數(shù)資料
| 型號： | ICS571 |
| 英文描述： | Low Phase Noise Zero Delay Buffer |
| 中文描述： | 低相位噪聲零延遲緩沖器 |
| 文件頁數(shù)： | 3/4頁 |
| 文件大?。?/td> | 61K |
| 代理商： | ICS571 |
ICS571
Low Phase Noise Zero Delay Buffer
MDS 571 B
Integrated Circuit Systems, Inc.525 Race StreetSan JoseCA95126(408)295-9800tel(408)295-9818fax
3
Revision 072899
Printed 11/14/00
PRELIMINARY INFORMATION
Electrical Specifications
Parameter
ABSOLUTE MAXIMUM RATINGS (Note 1)
Supply Voltage, VDD
Inputs
Clock Output
Ambient Operating Temperature
Soldering Temperature
Storage temperature
DC CHARACTERISTICS (VDD = 5.0V or 3.3V unless otherwise noted)
Operating Voltage, VDD
Input High Voltage, VIH, ICLK, FBIN
Input Low Voltage, VIL, ICLK, FBIN
Output High Voltage, VOH, CMOS level
Output High Voltage, VOH
Output Low Voltage, VOL
IDD Operating Supply Current, 133 in, 133 out
IDD Operating Supply Current, 50 in, 100 out
Short Circuit Current
Input Capacitance, ICLK, FBIN
AC CHARACTERISTICS (VDD = 5.0V or 3.3V unless otherwise noted)
Input Frequency, clock input
Input Frequency, clock input
Skew CLK/2 with respect to CLK
Input clock to output connected to FBIN
Output Clock Rise Time, 5V
Output Clock Fall Time, 5V
Output Clock Rise Time, 3.3V
Output Clock Fall Time, 3.3V
Output Clock Duty Cycle, 5V
Output Clock Duty Cycle, 3.3V
Absolute Clock Period Jitter, CLK, note 3
One Sigma Clock Period Jitter, CLK, note 3
Phase Noise, relative to carrier
Phase Noise, relative to carrier
Conditions
Minimum
Typical
Maximum
Units
Referenced to GND
Referenced to GND
Referenced to GND
7
V
V
V
°C
°C
°C
-0.5
-0.5
0
VDD+0.5
VDD+0.5
70
260
150
Max of 10 seconds
-65
3
5.5
V
V
V
V
V
V
Pins 1, 8
Pins 1, 8
IOH=-4mA
IOH=-25mA
IOL=25mA
No Load, 3.3V
No Load, 3.3V
Each Output
VDD/2+1
VDD/2
VDD/2
VDD/2-1
VDD-0.4
2.4
0.4
34
26
±100
5
mA
mA
mA
pF
FB from CLK
FB from CLK/2
Note 2
Note 2
0.8 to 2.0V, 15 pF load
2.0 to 0.8V, 15 pF load
0.8 to 2.0V, 15 pF load
2.0 to 0.8V, 15 pF load
at VDD/2
at VDD/2
Deviation from mean
20
10
150
-500
160
80
850
500
60
55
MHz
MHz
ps
ps
ns
ns
ns
ns
%
%
ps
ps
dBc/Hz
dBc/Hz
500
0.3
0.4
0.45
0.55
52 to 55
49 to 51
±80
50
-105
-115
40
45
1kHz offset
100kHz offset
Notes:
1. Stresses beyond these can permanently damage the device.
2. Assumes clocks with same rise time, measured from rising edges at VDD/2. Measured with 33
termination resistors and 15 pF loads. Applies to both 3.3V and 5V operation.
3. CLK/2 has lower jitter (both absolute and one sigma, in ps) than CLK.
相關PDF資料 |
PDF描述 |
|---|---|
| ICS571M | Low Phase Noise Zero Delay Buffer |
| ICS571MT | Low Phase Noise Zero Delay Buffer |
| ICS574 | Zero Delay, Low Skew Buffer |
| ICS574M | Zero Delay, Low Skew Buffer |
| ICS574MT | Zero Delay, Low Skew Buffer |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ICS571M | 功能描述:IC MULTIPLIER/ZDB 8-SOIC RoHS:否 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:ClockBlocks™ 產(chǎn)品變化通告:Product Discontinuation 04/May/2011 標準包裝:96 系列:- 類型:時鐘倍頻器，零延遲緩沖器 PLL:帶旁路 輸入:LVTTL 輸出:LVTTL 電路數(shù):1 比率 - 輸入:輸出:1:8 差分 - 輸入:輸出:無/無 頻率 - 最大:133.3MHz 除法器/乘法器:是/無 電源電壓:3 V ~ 3.6 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應商設備封裝:16-TSSOP 包裝:管件 其它名稱:23S08-5HPGG |
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| ICS571MLFT | 功能描述:IC BUFFER ZD LOW PH/NOISE 8-SOIC RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:ClockBlocks™ 標準包裝:2,000 系列:- 類型:PLL 時鐘發(fā)生器 PLL:帶旁路 輸入:LVCMOS，LVPECL 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:2:11 差分 - 輸入:輸出:是/無 頻率 - 最大:240MHz 除法器/乘法器:是/無 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應商設備封裝:32-TQFP（7x7） 包裝:帶卷 (TR) |
| ICS571MT | 功能描述:IC MULTIPLIER/ZDB 8-SOIC RoHS:否 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:ClockBlocks™ 產(chǎn)品變化通告:Product Discontinuation 04/May/2011 標準包裝:96 系列:- 類型:時鐘倍頻器，零延遲緩沖器 PLL:帶旁路 輸入:LVTTL 輸出:LVTTL 電路數(shù):1 比率 - 輸入:輸出:1:8 差分 - 輸入:輸出:無/無 頻率 - 最大:133.3MHz 除法器/乘法器:是/無 電源電壓:3 V ~ 3.6 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應商設備封裝:16-TSSOP 包裝:管件 其它名稱:23S08-5HPGG |
| ICS574 | 制造商:ICS 制造商全稱:ICS 功能描述:Zero Delay, Low Skew Buffer |
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