參數(shù)資料
型號: ICS650GI-36LFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 2/8頁
文件大?。?/td> 0K
描述: IC CLOCK NETWORK/PCI 16-TSSOP
標(biāo)準(zhǔn)包裝: 2,500
類型: 時鐘/頻率合成器
PLL: 帶旁路
輸入: 時鐘,晶體
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:4
差分 - 輸入:輸出: 無/無
頻率 - 最大: 25MHz
除法器/乘法器: 無/無
電源電壓: 3.135 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 帶卷 (TR)
其它名稱: 650GI-36LFT
ICS650-36
NETWORKING AND PCI CLOCK SOURCE
CLOCK SYNTHESIZER
IDT / ICS NETWORKING AND PCI CLOCK SOURCE
2
ICS650-36
REV F 051310
Pin Assignment
CLK Output Selection Table
Note: All frequencies are in MHz.
Pin Descriptions
12
1
11
2
10
3
9
X2
4
X1
5
GND
6
GND
7
CLK3
8
PDTS
REF
S0
VDD
S2
CLK1
S1
CLK2
GND
16
15
14
13
VDD
16-pin (173 mil) TSSOP
S2
S1
S0
REF
CLK1
CLK2
CLK3
0
OFF
33.30
50
125
0
1
ON
33.333
125
0
1
0
ON
33.333
66.666
125
0
1
ON
66.666
125
1
0
ON
33.333
50
125
1
0
1
ON
33.333
50
100
1
0
ON
33.333
66.666
100
1
ON
33.30
50
125
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
X2
Output
Crystal connection. Connect to 25 MHz crystal input or float for
clock.
2
X1
Input
Crystal connection. Connect to 25 MHz crystal or clock input.
3
GND
Power
Connect to ground.
4
CLK3
Output
Selectable clock output. See table above for frequency. Weak
internal pull-down when tri-state.
5
PDTS
Input
Powers down entire chip and tri-states outputs when low. Internal
pull-up resistor.
6
S2
Input
Select pin. Selects clock output frequency from table above.
Internal pull-up resistor.
7
CLK2
Output
Selectable clock output. See table above for frequency. Weak
internal pull-down when tri-state.
8
VDD
Power
Connect to +3.3 V.
9
S1
Input
Select pin. Selects clock output frequency from table above.
Internal pull-up resistor.
10
GND
Power
Connect to ground.
11
CLK1
Output
Selectable clock output. See table above for frequency. Weak
internal pull-down when tri-state.
12
VDD
Power
Connect to +3.3 V.
13
S0
Input
Select pin. Selects clock output frequency from table above.
Internal pull-up resistor.
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PDF描述
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