參數(shù)資料
型號: ICS650R-01LF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 2/8頁
文件大?。?/td> 0K
描述: IC CLK SOURCE SYST PERIPH 20SSOP
標準包裝: 55
類型: 時鐘/頻率合成器
PLL: 帶旁路
輸入: 時鐘,晶體
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:8
差分 - 輸入:輸出: 無/無
頻率 - 最大: 66.67MHz
除法器/乘法器: 無/無
電源電壓: 3 V ~ 5.5 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 20-SSOP(0.154",3.90mm 寬)
供應商設(shè)備封裝: 20-QSOP
包裝: 管件
產(chǎn)品目錄頁面: 1252 (CN2011-ZH PDF)
其它名稱: 650R-01LF
800-1085
800-1085-5
800-1085-ND
ICS650-01
SYSTEM PERIPHERAL CLOCK SOURCE
CLOCK SYNTHESIZER
IDT / ICS SYSTEM PERIPHERAL CLOCK SOURCE
2
ICS650-01
REV H 051310
Pin Assignment
USB Clock (MHz)
Processor Clock (MHz)
Audio Clock (MHz)
0 = connect directly to ground
1 = connect directly to VDD
M = leave unconnected (floating)
Pin Descriptions
USEL
UCLK
012
M24
148
13
4
12
5
11
VDD
8
9
10
VDD
20M
14.318M
OE
ACLK
PCLK1
17
16
PCLK4
3
X1/ICLK
VDD
PCLK3
18
PCLK2
1
USEL
X2
PSEL0
20
PSEL1
19
14
2
7
GND
UCLK
ASEL
GND
15
6
20 pin (150 mil) SSOP
PSEL1
PSEL0
PCLK1
PCLK2, 3
PCLK4
0
25
50
18.75
0
M
TEST
0
1
TEST
M
0
40
80
20
M
33.3334
66.6667
25
M
1
20
40
25
1
0
20
33.3334
25
1
M
20
66.6667
25
1
Stops low all clocks except 20M
ASEL
ACLK
0
49.152
M
24.576
1
12.288
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
USEL
Input
UCLK select pin. Determines frequency of USB clock per table above.
2
X2
XO
Crystal connection. Connect to parallel mode 14.31818 MHz crystal.
Leave open for clock.
3
X1/ICLK
XI
Crystal connection. Connect to parallel mode 14.31818 MHz crystal or
clock.
4
VDD
Power
Connect to VDD. Must be same value as other VDD. Decouple with pin 6.
5
VDD
Power
Connect to VDD. Must be same value as other VDD.
6
GND
Power
Connect to ground.
7
UCLK
Output
USB clock output per table above.
8
20M
Output
Fixed 20 MHz output for Ethernet. Only clock that runs when
PSEL1=PSEL0=1.
9
ACLK
Output
AC97 audio clock output per table above.
10
PCLK4
Output
PCLK output number 4 per table above.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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