參數(shù)資料
型號(hào): ICS650R-01LFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 5/8頁
文件大小: 0K
描述: IC CLK SYNTHESIZER 20-SSOP
標(biāo)準(zhǔn)包裝: 2,500
類型: 時(shí)鐘/頻率合成器
PLL: 帶旁路
輸入: 時(shí)鐘,晶體
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:8
差分 - 輸入:輸出: 無/無
頻率 - 最大: 66.67MHz
除法器/乘法器: 無/無
電源電壓: 3 V ~ 5.5 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 20-SSOP(0.154",3.90mm 寬)
供應(yīng)商設(shè)備封裝: 20-QSOP
包裝: 帶卷 (TR)
其它名稱: 650R-01LFT
ICS650-01
SYSTEM PERIPHERAL CLOCK SOURCE
CLOCK SYNTHESIZER
IDT / ICS SYSTEM PERIPHERAL CLOCK SOURCE
5
ICS650-01
REV H 051310
AC Electrical Characteristics
Unless stated otherwise, VDD = 3.3 V ±5% (or 5 V unless noted), Ambient Temperature 0 to +70
° C
Note 1: Measured with 15 pF load
Thermal Characteristics
Marking Diagram—ICS650R-01LF
Marking Diagram—ICS650R-01ILF
Notes:
1. ###### is the lot code.
2. YYWW is the last two digits of the year, and the week number that the part was assembled.
3. “LF” denotes Pb (lead) free package.
4. “I” denotes industrial grade device.
5. Bottom marking: (origin) = country of origin if not USA.
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
14.31818
MHz
Output Clocks Accuracy
(synthesis error)
All clocks
1
ppm
Output Rise Time
tOR
0.8 to 2.0 V, Note 1
1.5
ns
Output Fall Time
tOF
2.0 to 0.8 V, Note 1
1.5
ns
Output Clock Duty Cycle
At VDD/2
40
50
60
%
One Sigma Jitter
except ACLK
75
ps
ACLK
170
ps
Absolute Clock Period Jitter
PCLK, UCLK, 20M
-500
500
ps
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Thermal Resistance Junction to
Ambient
θJA
Still air
135
° C/W
θJA
1 m/s air flow
93
° C/W
θJA
3 m/s air flow
78
° C/W
Thermal Resistance Junction to Case
θJC
60
° C/W
10
20
11
1
650R-01LF
######
YYWW
10
20
11
1
650R-01ILF
######
YYWW
相關(guān)PDF資料
PDF描述
VE-B4K-MY-F2 CONVERTER MOD DC/DC 40V 50W
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參數(shù)描述
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