參數(shù)資料
型號： ICS840004AGT
英文描述： FEMTOCLOCKS CRYSTAL-TO LVCMOS/LVTTL FREQUENCY SYNTHESIZER
中文描述： FEMTOCLOCKS晶體到的LVCMOS / LVTTL頻率合成器
文件頁數(shù)： 1/13頁
文件大?。?/td> 310K
代理商： ICS840004AGT
Integrated
Circuit
Systems, Inc.
840004AG
www.icst.com/products/hiperclocks.html
REV. A SEPTEMBER 16, 2004
1
ICS840004
F
EMTO
C
LOCKS
C
RYSTAL
-
TO
-
LVCMOS/LVTTL F
REQUENCY
S
YNTHESIZER
PRELIMINARY
G
ENERAL
D
ESCRIPTION
The ICS840004 is a 4 output LVCMOS/LVTTL
Synthesizer optimized to generate Ethernet
reference clock frequencies and is a member of
the HiPerClocks
TM
family of high performance
clock solutions from ICS. Using a 26.5625MHz,
18pF parallel resonant crystal, the following frequencies can be
generated based on the 2 frequency select pins (F_SEL1:0):
212.5MHz, 159.375MHz, 156.25MHz, 106.25MHz, and
53.125MHz. The ICS840004 uses ICS’ 3
rd
generation low phase
noise VCO technology and can achieve 1ps or lower typical
random rms phase jitter, easily meeting Ethernet jitter
requirements. The ICS840004 is packaged in a small 20-pin
TSSOP package.
HiPerClockS
ICS
B
LOCK
D
IAGRAM
F
EATURES
Four LVCMOS/LVTTL outputs, 15
typical output impedance
Selectable crystal oscillator interface
or LVCMOS single-ended input
Supports the following input frequencies:
212.5MHz, 159.375MHz, 156.25MHz, 106.25MHz and
53.125MHz
RMS phase jitter @ 212.5MHz (637KHz - 10MHz):
0.98ps typical
RMS phase noise at 212.5MHz, V
DDO
= 3.3V
Phase noise:
Offset
Noise Power
100Hz ............... -88.8 dBc/Hz
1KHz ..............-109.0 dBc/Hz
10KHz ..............-116.1 dBc/Hz
100KHz ..............-117.5 dBc/Hz
Full 3.3V or 3.3V core/2.5V output supply mode
0°C to 70°C ambient operating temperature
Q0
Q1
Q2
Q3
OE
F_SEL1:0
nPLL_SEL
nXTAL_SEL
XTAL_IN
XTAL_OUT
TEST_CLK
MR
OSC
Phase
Detector
VCO
M = ÷24 (fixed)
F_SEL1:0
0 0 ÷3
0 1 ÷4
1 0 ÷6
(default)
1 1 ÷12
0
1
1
0
2
N
26.5625MHz
Pullup
Pulldown
Pulldown
Pulldown
Pulldown:Pulldown
Pulldown
F
REQUENCY
S
ELECT
F
UNCTION
T
ABLE
P
IN
A
SSIGNMENT
ICS840004
20-Lead TSSOP
6.5mm x 4.4mm x 0.92mm
package body
G Package
Top View
F_SEL0
nc
nXTAL_SEL
TEST_CLK
OE
MR
nPLL_SEL
V
DDA
nc
V
DD
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
F_SEL1
GND
Q0
Q1
V
DDO
Q2
Q3
GND
XTAL_IN
XTAL_OUT
s
u
D
u
V
2
2
2
2
2
p
M
n
t
c
e
u
n
g
p
e
n
5
1
3
5
2
0
1
1
5
2
5
1
t
u
u
q
a
2
O
e
r
R
y
F
t
n
2
2
2
2
6
1
u
e
6
6
6
6
4
p
u
n
q
e
5
2
5
2
5
2
5
2
0
2
y
c
5
5
5
5
6
r
F
1
L
E
S
_
F
0
L
E
S
_
F
r
e
d
e
r
e
d
D
u
V
3
4
6
1
4
N
e
N
u
V
8
6
4
2
6
/
M
e
o
R
0
0
1
1
0
0
1
0
1
1
4
4
4
4
4
5
7
5
5
2
1
2
5
The Preliminary Information presented herein represents a product in prototyping or pre-production. The noted characteristics are based on initial
product characterization. Integrated Circuit Systems, Incorporated (ICS) reserves the right to change any circuitry or specifications without notice.
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