參數(shù)資料
型號: ICS8402AYILFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 14/19頁
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描述: IC FREQ SYNTHESIZER 32-LQFP
標準包裝: 1,000
系列: HiPerClockS™
類型: 頻率合成器
PLL: 帶旁路
輸入: 晶體
輸出: LVCMOS,LVTTL
電路數(shù): 1
比率 - 輸入:輸出: 1:2
差分 - 輸入:輸出: 無/無
頻率 - 最大: 350MHz
除法器/乘法器: 是/無
電源電壓: 3.135 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 32-LQFP
供應商設備封裝: 32-TQFP(7x7)
包裝: 帶卷 (TR)
其它名稱: 8402AYILFT
ICS8402I
350MHZ, CRYSTAL-TO-LVCMOS/LVTTL FREQUENCY SYNTHESIZER
IDT / ICS LVCMOS/LVTTL FREQUENCY SYNTHESIZER
4
ICS8402AYI REV. A OCTOBER 16, 2007
Table 2. Pin Characteristics
Function Tables
Table 3A. Parallel and Serial Mode Function Table
NOTE:
L = LOW
H = HIGH
X = Don’t care
↑ = Rising edge transition
↓ = Falling edge transition
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
CPD
Power Dissipation Capacitance
(per output)
VDD, VDDO = 3.465V
13
pF
VDD = 3.465V, VDDO = 2.625V
11
pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN Input Pulldown Resistor
51
k
ROUT
Output Impedance
VDDO = 3.465V
5
7
12
VDDO = 2.625V
7
Inputs
Conditions
MR
nP_LOAD
M
N
S_LOAD
S_CLOCK
S_DATA
H
X
Reset. Forces outputs LOW.
L
Data
X
Data on M and N inputs passed directly to the M divider
and N output divider. TEST output forced LOW.
L
Data
L
X
Data is latched into input registers and remains loaded
until next LOW transition or until a serial event occurs.
LH
X
L
Data
Serial input mode. Shift register is loaded with data on
S_DATA on each rising edge of S_CLOCK.
LH
X
LData
Contents of the shift register are passed to the
M divider and N output divider.
LH
X
L
Data
M divider and N output divider values are latched.
L
H
X
L
X
Parallel or serial input do not affect shift registers.
LH
X
H
Data
S_DATA passed directly to M divider as it is clocked.
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