IDT / ICS 3.3V LVPECL FREQUENCY SYNTHESIZ" />
參數(shù)資料
型號(hào)： ICS843004AG-02LFT
廠(chǎng)商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 2/18頁(yè)
文件大?。?/td> 0K
描述： IC SYNTHESIZER LVPECL 24-TSSOP
標(biāo)準(zhǔn)包裝： 2,500
系列： HiPerClockS™, FemtoClock™
類(lèi)型： 頻率合成器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:4
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 680MHz
除法器/乘法器： 是/無(wú)
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 24-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 24-TSSOP
包裝： 帶卷 (TR)
其它名稱(chēng)： 843004AG-02LFT
IDT / ICS 3.3V LVPECL FREQUENCY SYNTHESIZER
10
ICS843004AG-02 REV A JULY 30, 2007
ICS843004-02
CRYSTAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
TERMINATION FOR 3.3V LVPECL OUTPUT
V
CC - 2V
50
Ω
50
Ω
RTT
Z
o = 50Ω
Z
o = 50Ω
FOUT
FIN
RTT =
Z
o
1
((V
OH + VOL) / (VCC – 2)) – 2
3.3V
125
Ω
125
Ω
84
Ω
84
Ω
Z
o = 50Ω
Z
o = 50Ω
FOUT
FIN
The clock layout topology shown below is a typical ter mina-
tion for LVPECL outputs. The two different layouts mentioned
are recommended only as guidelines.
FOUT and nFOUT are low impedance follower outputs that
generate ECL/LVPECL compatible outputs. Therefore, ter-
minating resistors (DC current path to ground) or current
sources must be used for functionality. These outputs are
FIGURE 4B. LVPECL OUTPUT TERMINATION
FIGURE 4A. LVPECL OUTPUT TERMINATION
designed to drive 50
Ω transmission lines. Matched imped-
ance techniques should be used to maximize operating fre-
quency and minimize signal distor tion.
Figures 4A and 4B
show two different layouts which are recommended only as
guidelines. Other suitable clock layouts may exist and it
would be recommended that the board designers simulate
to guarantee compatibility across all printed circuit and clock
component process variations.
相關(guān)PDF資料
PDF描述
VE-J0B-MZ-F2 CONVERTER MOD DC/DC 95V 25W
VE-JT2-MZ-F4 CONVERTER MOD DC/DC 15V 25W
VE-JT1-MZ-F4 CONVERTER MOD DC/DC 12V 25W
VE-JT0-MZ-F2 CONVERTER MOD DC/DC 5V 25W
VE-J04-MZ-F3 CONVERTER MOD DC/DC 48V 25W
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