參數(shù)資料
型號: ICS843004AGI
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時鐘產(chǎn)生/分配
英文描述: 226.66 MHz, OTHER CLOCK GENERATOR, PDSO24
封裝: 4.40 X 7.80 MM, 0.92 MM HEIGHT, MO-153, TSSOP-24
文件頁數(shù): 2/16頁
文件大?。?/td> 452K
代理商: ICS843004AGI
843004AGI
www.icst.com/products/hiperclocks.html
REV. A FEBRUARY 11, 2005
10
Integrated
Circuit
Systems, Inc.
ICS843004I
FEMTOCLOCKSCRYSTAL-TO-
3.3V, 2.5V LVPECL FREQUENCY SYNTHESIZER
LAYOUT GUIDELINE
Figure 5 shows a schematic example of the ICS843004I. An
example of LVEPCL termination is shown in this schematic. Ad-
ditional LVPECL termination approaches are shown in the
LVPECL Termination Application Note. In this example, an 18pF
FIGURE 5. ICS843004I SCHEMATIC EXAMPLE
parallel resonant 26.5625MHz crystal is used. The C1=27pF
and C2=33pF are recommended for frequency accuracy. For
different board layout, the C1 and C2 may be slightly adjusted
for optimizing frequency accuracy.
VCC=3.3V
C3
10uF
+
-
VCCO=3.3V
R3
133
To Logic
Input
pins
3.3V
VCC
Zo = 50 Ohm
Set Logic
Input to
'0'
C7
0.1u
3.3V
RD2
1K
VCC
VDD
VC
C
R10
82.5
R4
82.5
VCCA
Logic Control Input Examples
VDD
C2
33pF
C4
0.01u
+
-
Zo = 50 Ohm
RD1
Not Install
Zo = 50 Ohm
RU2
Not Install
R7
133
R8
82.5
C9
0.1u
C1
27pF
Set Logic
Input to
'1'
R9
133
X1
26.5625MHz
R2
10
18pF
To Logic
Input
pins
Zo = 50 Ohm
VCCO
R6
82.5
C6
0.1u
U1
ICS843004
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
nQ
1
Q1
VC
C
O
Q0
nQ
0
MR
nPLL_SE
L
NC
VC
C
A
F_
S
E
L
0
VC
C
F_
S
E
L
1
X
T
AL_O
U
T
X
T
AL_I
N
VE
E
T
EST
_C
LK
nX
T
A
L_SE
L
VC
C
VE
E
nQ
3
Q3
VC
C
O
Q2
nQ
2
C8
0.1u
R5
133
RU1
1K
VC
C
O
ICS843004I
FEMTOCLOCKS CRYSTAL/LVCMOS-TO-3.3V,2.5V LVPECL FREQUENCY SYNTHESIZER
TSD
IDT / ICS FEMTOCLOCKS CRYSTAL/LVCMOS-TO-3.3V,2.5V LVPECL FREQUENCY SYNTHESIZER
ICS843004I
10
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