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參數(shù)資料
| 型號(hào)： | ICS84330CY |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時(shí)鐘產(chǎn)生/分配 |
| 英文描述： | 700 MHz, OTHER CLOCK GENERATOR, PQFP32 |
| 封裝： | 7 X 7 MM, 1.40 MM HEIGHT, MS-026BBA, LQFP-32 |
| 文件頁數(shù)： | 4/19頁 |
| 文件大?。?/td> | 292K |
| 代理商： | ICS84330CY |
84330CV
www.icst.com/products/hiperclocks.html
REV. C APRIL 10, 2007
12
Integrated
Circuit
Systems, Inc.
ICS84330C
700MHZ, LOW JITTER, CRYSTAL-TO-3.3V
DIFFERENTIAL LVPECL FREQUENCY SYNTHESIZER
If the FREF_EXT input is driven by a 3.3V LVCMOS driver, the
jitter performance can be improved by reducing the amplitude
swing and slowing down the edge rate. Figure 7A shows an
amplitude reduction approach for a long trace. The swing will
be approximately 0.85V for logic low and 2.5V for logic high
R2
100
VDD
R1
100
Ro ~ 7 Ohm
Driver_LVCMOS
Zo = 50 Ohm
Td
RS
43
VDD
GND
TEST_CLK
VDD
GND
TEST_CLK
R1
200
RS
100
Ro ~ 7 Ohm
Driver_LVCMOS
R2
200
VDD
R1
400
R2
400
Ro ~ 7 Ohm
Driver_LVCMOS
RS
200
VDD
GND
TEST_CLK
JITTER REDUCTION FOR FREF_EXT SINGLE END INPUT
(instead of 0V to 3.3V). Figure 7B shows amplitude reduction
approach for a short trace. The circuit shown in Figure 7C
reduces amplitude swing and also slows down the edge rate
by increasing the resistor value.
FIGURE 7C. EDGE RATE REDUCTION BY INCREASING THE RESISTOR VALUE
FIGURE 7A. AMPLITUDE REDUCTION FOR A LONG TRACE
FIGURE 7B. AMPLITUDE REDUCTION FOR A SHORT TRACE
FREF_EXT
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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