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參數(shù)資料
| 型號： | ICS844002AGI-01LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 9/14頁 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER 2LVDS 20-TSSOP |
| 標準包裝： | 74 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | 時鐘，晶體 |
| 輸出： | LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 170MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.375 V ~ 2.625 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 20-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | 800-1956-5 844002AGI-01LF ICS844002AGI-01LF-ND |
ICS844002I-01
FEMTOCLOCKS CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER
IDT / ICS LVDS FREQUENCY SYNTHESIZER
4
ICS844002AGI-01 REV. D OCTOBER 20, 2008
Table 3C. LVDS DC Characteristics, VDD = VDDA = VDDO = 2.5V ± 5%, TA = -40°C to 85°C
Table 4. Crystal Characteristics
AC Electrical Characteristics
Table 5. AC Characteristics, VDD = VDDA = VDDO = 2.5V ± 5%, TA = -40°C to 85°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when device
is mounted in a test socket with maintained transverse airflow greater than 500 lfpm. Device will meet specifications after thermal
equilibrium has been reached under these conditions.
NOTE 1: Defined as skew between outputs at the same supply voltages and with equal load conditions. Measured at VDDO/2.
NOTE 2: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 3: Please refer to the Phase Noise Plot.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
VOD
Differential Output Voltage
240
550
mV
V
OD
VOD Magnitude Change
40
mV
VOS
Offset Voltage
0.7
1.1
1.5
V
OS
VOS Magnitude Change
50
mV
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
Mode of Oscillation
Fundamental
Frequency
22.4
25
27.2
MHz
Equivalent Series Resistance (ESR)
50
Shunt Capacitance
7pF
Drive Level
1mW
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency
FSEL[1:0] = 00
140
170
MHz
FSEL[1:0] = 01
112
136
MHz
FSEL[1:0] = 10
56
68
MHz
tsk(o)
Output Skew; NOTE 1, 2
5
20
ps
tjit()
RMS Phase Jitter, (Random);
NOTE 3
156.25MHz, (1.875MHz – 20MHz)
0.41
ps
125MHz, (1.875MHz – 20MHz)
0.44
ps
62.5MHz, (1.875MHz – 20MHz)
0.47
ps
tR / tF
Output Rise/Fall Time
20% to 80%
250
550
ps
odc
Output Duty Cycle
48
52
%
tL
PLL Lock Time
100
ms
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PDF描述 |
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參數(shù)描述 |
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