IDT / ICS LVDS CLOCK GENERATOR 7 I" />
參數(shù)資料
型號: ICS844021BGI-01LF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 12/14頁
文件大?。?/td> 0K
描述: IC CLOCK GEN ETHERNET 8TSSOP
產(chǎn)品培訓(xùn)模塊: PCI-Express
標(biāo)準(zhǔn)包裝: 96
系列: HiPerClockS™, FemtoClock™
類型: 時(shí)鐘發(fā)生器
PLL:
輸入: 晶體
輸出: LVDS
電路數(shù): 1
比率 - 輸入:輸出: 1:1
差分 - 輸入:輸出: 無/是
頻率 - 最大: 170MHz
除法器/乘法器: 是/是
電源電壓: 2.375 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 8-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 8-TSSOP
包裝: 管件
其它名稱: 844021BGI-01LF
ICS844021BGI-01LF-ND
IDT / ICS LVDS CLOCK GENERATOR
7
ICS844021BGI-01 REV. A NOVEMBER 6, 2012
ICS844021I-01
FEMTOCLOCKS CRYSTAL-TO-LVDS CLOCK GENERATOR
APPLICATION INFORMATION
FIGURE 2. CRYSTAL INPUt INTERFACE
CRYSTAL INPUT INTERFACE
The ICS844021I-01 has been characterized with 18pF parallel
resonant crystals. The capacitor values, C1 and C2, shown in
Figure 2 below were determined using a 25MHz, 18pF parallel
resonant crystal and were chosen to minimize the ppm error.
The optimum C1 and C2 values can be slightly adjusted for
different board layouts.
C1
33p
X1
18pF Parallel Crystal
C2
27p
XTAL_OUT
XTAL_IN
POWER SUPPLY FILTERING TECHNIQUES
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. To achieve optimum jitter perfor-
mance, power supply isolation is required. The ICS844021I-01
provides separate power supplies to isolate any high switching
noise from the outputs to the internal PLL. V
DD and VDDA should
be individually connected to the power supply plane through vias,
and 0.01F bypass capacitors should be used for each pin.
Fig-
ure 1 illustrates this for a generic V
DD pin and also shows that
V
DDA requires that an additional10Ω resistor along with a 10F
bypass capacitor be connected to the V
DDA pin.
FIGURE 1. POWER SUPPLY FILTERING
10
Ω
V
DDA
10
μF
.01
μF
3.3V or 2.5V
.01
μF
V
DD
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PDF描述
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參數(shù)描述
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