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參數(shù)資料
| 型號： | ICS8523BGILF |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 8523 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| 封裝： | 6.50 X 4.40 MM, 0.92 MM HEIGHT, LEAD FREE, MS-153, TSSOP-20 |
| 文件頁數(shù)： | 1/16頁 |
| 文件大?。?/td> | 225K |
| 代理商： | ICS8523BGILF |
8523BGI
www.icst.com/products/hiperclocks.html
REV. C SEPTEMBER 16, 2004
1
Integrated
Circuit
Systems, Inc.
ICS8523I
LOW SKEW, 1-TO-4
DIFFERENTIAL-TO-HSTL FANOUT BUFFER
BLOCK DIAGRAM
PIN ASSIGNMENT
ICS8523I
20-Lead TSSOP
6.5mm x 4.4mm x 0.92mm body package
G Package
Top View
GND
CLK_EN
CLK_SEL
CLK
nCLK
PCLK
nPCLK
nc
VDD
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
Q0
nQ0
VDDO
Q1
nQ1
Q2
nQ2
VDDO
Q3
nQ3
GENERAL DESCRIPTION
The ICS8523I is a low skew, high perfor-
mance 1-to-4 Differential-to-HSTL fanout buffer
and a member of the HiPerClockSfamily of High
Performance Clock Solutions from ICS. The
ICS8523I has two selectable clock inputs. The
CLK, nCLK pair can accept most standard differential input
levels. The PCLK, nPCLK pair can accept LVPECL, CML, or
SSTL input levels. The clock enable is internally synchronized
to eliminate runt pulses on the outputs during asynchronous
assertion/deassertion of the clock enable pin.
Guaranteed output and part-to-part skew characteristics
make the ICS8523I ideal for those applications demanding
well defined performance and repeatability.
FEATURES
4 differential HSTL compatible outputs
Selectable diffferential CLK, nCLK or LVPECL clock inputs
CLK, nCLK pair can accept the following differential
input levels: LVDS, LVPECL, HSTL, SSTL, HCSL
PCLK, nPCLK supports the following input types:
LVPECL, CML, SSTL
Maximum output frequency: 650MHz
Translates any single-ended input signal to HSTL
levels with resistor bias on nCLK input
Output skew: 50ps (maximum)
Part-to-part skew: 250ps (maximum)
Propagation delay: 1.6ns (maximum)
3.3V core, 1.8V output operating supply
Lead-Free package available
-40°C to 85°C ambient operating temperature
HiPerClockS
ICS
CLK
nCLK
PCLK
nPCLK
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
0
1
CLK_EN
CLK_SEL
D
Q
LE
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PDF描述 |
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