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參數(shù)資料
| 型號： | ICS853014BGLFT |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 853014 SERIES, LOW SKEW CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| 封裝： | 6.50 X 4.40 MM, 0.92 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-20 |
| 文件頁數(shù)： | 12/19頁 |
| 文件大?。?/td> | 1209K |
| 代理商： | ICS853014BGLFT |
ICS853014
LOW SKEW, 1-TO-5, DIFFERENTIAL-TO-2.5V, 3.3V LVPECL/ECL FANOUT BUFFER
IDT / ICS 2.5V, 3.3V LVPECL/ECL FANOUT BUFFER
2
ICS853014BG REV. DNOVEMBER 12, 2007
Table 1. Pin Descriptions
NOTE: Pullup refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 2
Q0, Q0
Output
Differential output pair. LVPECL/ECL interface levels.
3, 4
Q1, Q1
Output
Differential output pair. LVPECL/ECL interface levels.
5, 6
Q2, Q2
Output
Differential output pair. LVPECL/ECL interface levels.
7, 8
Q3, Q3
Output
Differential output pair. LVPECL/ECL interface levels.
9, 10
Q4, Q4
Output
Differential output pair. LVPECL/ECL interface levels.
11
VEE
Power
Negative supply pin.
12
CLK_SEL
Input
Pulldown
Clock select input. When HIGH, selects PCLK1/PCLK1 inputs. When LOW,
selects PCLK0/PCLK0 inputs. LVTTL / LVCMOS interface levels.
13
PCLK0
Input
Pulldown
Non-inverting differential LVPECL clock input.
14
PCLK0
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VCC/2 default when left floating.
15
VBB
Output
Bias voltage.
16
PCLK1
Input
Pulldown
Non-inverting differential LVPECL clock input.
17
PCLK1
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VCC/2 default when left floating.
18, 20
VCC
Power
Positive supply pins.
19
EN
Input
Pulldown
Synchronizing clock enable. When LOW, clock outputs follow clock input.
When HIGH, Qx outputs are forced low, Qx outputs are forced high.
LVTTL/LVCMOS interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
RPULLDOWN
Input Pulldown Resistor
75
k
RVCC/2
Pullup/Pulldown Resistors
50
k
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