參數(shù)資料
型號(hào)： ICS87021AMILF
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 1/14頁(yè)
文件大?。?/td> 0K
描述： IC CLK GENERATOR /1 /2 8-SOIC
標(biāo)準(zhǔn)包裝： 97
系列： HiPerClockS™
類型： 時(shí)鐘發(fā)生器，扇出配送，多路復(fù)用器
PLL： 無
輸入： HCSL，LVDS，LVHSTL，LVPECL，SSTL
輸出： LVCMOS，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 是/無
頻率 - 最大： 250MHz
除法器/乘法器： 是/無
電源電壓： 2.375 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 8-SOIC
包裝： 管件
產(chǎn)品目錄頁(yè)面： 1250 (CN2011-ZH PDF)
其它名稱： 800-1196
800-1196-5
800-1196-ND
87021AMILF
÷1/÷2 DIFFERENTIAL-TO-LVCMOS/LVTTL
CLOCK GENERATOR
ICS87021I
IDT / ICS LVCMOS CLOCK GENERATOR
1
ICS87021AMI REV. B AUGUST 26, 2008
GENERAL DESCRIPTION
The ICS87021I is a high perfor mance ÷1/÷2
Differential-to-LVCMOS/LVTTL Clock Generator
and a member of the HiPerClockS family of High
Performance Clock Solutions from IDT. The CLK,
nCLK pair can accept most standard differential
input levels. Guaranteed part-to-part skew characteristics make
the ICS87021I ideal for those clock distribution applications de-
manding well defined performance and repeatability.
FEATURES
Two single-ended LVCMOS/LVTTL outputs
One differential CLK, nCLK input pair
CLK, nCLK pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, SSTL, HCSL
Maximum output frequency: 250MHz
Additive phase jitter, RMS: 0.18ps (typical)
Output skew: 50ps (maximum)
Part-to-part skew: 450ps (maximum)
Propagation delay: 3.4ns (maximum)
Full 3.3V or 2.5V operating supply
-40°C to 85°C ambient operating temperature
Availalbe in both standard (RoHS 5) and lead-free (RoHS 6)
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
HiPerClockS
ICS
ICS87021I
8-Lead SOIC
3.90mm x 4.90mm x 1.375mm package body
M Package
Top View
CLK
nCLK
MR
F_SEL
1
2
3
4
VDD
Q0
Q1
GND
8
7
6
5
Q0
Q1
CLK
nCLK
MR
F_SEL
0
1
÷1
÷2
R
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PDF描述
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參數(shù)描述
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