ICS8705I NRND C4 0.1uF VDD R4 1K Zo" />
參數(shù)資料
型號： ICS8705BYILFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 4/18頁
文件大?。?/td> 0K
描述： IC CLOCK GENERATOR ZD 32-LQFP
標(biāo)準(zhǔn)包裝： 1,000
系列： HiPerClockS™
類型： 時鐘發(fā)生器
PLL： 帶旁路
輸入： HCSL，LVCMOS，LVDS，LVHSTL，LVPECL，LVTTL，SSTL
輸出： LVCMOS，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:8
差分 - 輸入:輸出： 是/無
頻率 - 最大： 250MHz
除法器/乘法器： 是/是
電源電壓： 2.375 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-LQFP
供應(yīng)商設(shè)備封裝： 32-TQFP（7x7）
包裝： 帶卷 (TR)
其它名稱： 8705BYILFT
8705BYI
www.idt.com
REV. E MAY 30, 2013
12
Zero Delay, Differential-to-LVCMOS/
LVTTL Clock Generator
ICS8705I
NRND
C4
0.1uF
VDD
R4
1K
Zo = 50
VDD
R7
10 - 15
VDD
R2
43
RD1
Not Install
(U1-24)
(U1-32)
Logic Input Pin Examples
C3
0.1uF
R5
1K
SEL2
C7
0.1uF
To Logic
Input
pins
(U1-9)
VDD
U1
ICS8705
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
32
31
30
29
28
27
26
25
SEL0
SEL1
CLK0
nc
CLK1
nCLK1
CLK_SEL
MR
VD
D
FB
_
IN
SEL
2
V
DDO
Q0
GN
D
Q1
V
DDO
Q2
GND
Q3
VDDO
Q4
GND
Q5
VDDO
VD
D
PLL_
SEL
VD
D
A
SEL
3
VD
D
O
Q7
GN
D
Q6
VDD=3.3V or 2.5V
To Logic
Input
pins
R4
43
VDD
C16
10u
PLL_
SEL
R1
43
C2
0.1uF
Zo = 50
(U1-12)
(U1-16)
(U1-28)
SEL3
SEL1
RU2
Not Install
VDDA
C1
0.1uF
Ro ~ 7 Ohm
Driv er_LVCMOS
(U1-20)
SEL0
C5
0.1uF
Set Logic
Input to
'1'
RU1
1K
Set Logic
Input to
'0'
C6
0.1uF
RD2
1K
C11
0.01u
LAYOUT GUIDELINE
The schematic of the ICS8705I layout example is shown in
Figure 4A. The ICS8705I recommended PCB board layout
for this example is shown in
Figure 4B. This layout example is
used as a general guideline. The layout in the actual system will
depend on the selected component types, the density of the
components, the density of the traces, and the stack up of the
P.C. board.
FIGURE 4A. ICS8705I LVCMOS CLOCK GENERATOR SCHEMATIC EXAMPLE
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PDF描述
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參數(shù)描述
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