參數(shù)資料
型號: ICS8745AYIT
元件分類: 時鐘及定時
英文描述: PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32
封裝: 7 X 7 MM, 1.40 MM HEIGHT, LQFP-32
文件頁數(shù): 12/13頁
文件大?。?/td> 163K
代理商: ICS8745AYIT
8745AYI
www.icst.com/products/hiperclocks.html
REV. A JANUARY 31, 2003
8
Integrated
Circuit
Systems, Inc.
ICS8745I
1:5 DIFFERENTIAL-TO-LVDS
ZERO DELAY CLOCK GENERATOR
APPLICATION INFORMATION
Figure 1 shows how the differential input can be wired to accept
single ended levels. The reference voltage V_REF ~ V
DD/2 is
generated by the bias resistors R1, R2 and C1. This bias circuit
should be located as close as possible to the input pin. The ratio
FIGURE 1. SINGLE ENDED SIGNAL DRIVING DIFFERENTIAL INPUT
R2
1K
V
DD
CLK_IN
+
-
R1
1K
C1
0.1uF
V_REF
WIRING THE DIFFERENTIAL INPUT TO ACCEPT SINGLE ENDED LEVELS
of R1 and R2 might need to be adjusted to position the V_REF in
the center of the input voltage swing. For example, if the input
clock swing is only 2.5V and V
DD = 3.3V, V_REF should be 1.25V
and R2/R1 = 0.609.
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PDF描述
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參數(shù)描述
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