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參數(shù)資料
| 型號： | ICS87931I |
| 英文描述： | LOW SKEW, 1-TO-6 LVCMOS/LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER |
| 中文描述： | 低偏移，1到6的LVCMOS / LVTTL時鐘倍頻/零延遲緩沖器 |
| 文件頁數(shù)： | 10/14頁 |
| 文件大?。?/td> | 166K |
| 代理商： | ICS87931I |
87931BYI
www.icst.com/products/hiperclocks.html
10
REV. A JUNE 23, 2003
ICS87931I
L
OW
S
KEW
, 1-
TO
-6
LVCMOS/LVTTL C
LOCK
M
ULTIPLIER
/Z
ERO
D
ELAY
B
UFFER
F
IGURE
4A. ICS87931I S
CHEMATIC
E
XAMPLE
S
CHEMATIC
E
XAMPLE
Figure 4A shows a schematic example of using an ICS87931I. It
is recommended to have one decouple capacitor per power pin.
Each decoupling capacitor should be located as close as pos-
sible to the power pin. The low pass filter R7, C11 and C16 for
clean analog supply should also be located as close to the V
DDA
pin as possible.
VDD=3.3V
SP = Space (i.e. not intstalled)
R4
1K
C2
0.1uF
R2
43
VDD
Set Logic
Input to
’1’
To Logic
Input
pins
R3
1K
POWER_DN
Set Logic
Input to
’0’
C16
10u
Zo = 50 Ohm
R8
50
RU2
Not Install
Zo = 50
C11
0.01u
D
VDD
C
Receiver
VDD
R9
50
D
R1
43
R10
50
To Logic
Input
pins
R7
10 - 15
(U1-28)
RD2
1K
VDD
Receiver
VDD
VDD
U1
ICS87931I
1
2
3
4
5
6
7
8
9
1
1
1
1
1
1
1
17
18
19
20
21
22
23
24
3
3
3
2
2
2
2
2
nc
VDDA
POWER_DN
CLK1
nMR
CLK0
nCLK0
GND
n
C
C
E
V
Q
Q
G
nc
PLL_SEL
EXTFVDDO
QB1
QB0
n
D
D
D
V
Q
Q
G
Logic Input Pin Examples
RU1
1K
(U1-13)
C3
0.1uF
Zo = 50 Ohm
D
RD1
Not Install
Zo = 50
3.3V PECL Driver
C
R5
1K
C1
0.1uF
3.3V
(U1-21)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS87931BYIT | LOW SKEW, 1-TO-6 LVCMOS/LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER |
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| ICS87949AY-01 | LOW SKEW ±1, ±2 CLOCK GENERATOR |
| ICS87949AY-01T | LOW SKEW ±1, ±2 CLOCK GENERATOR |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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