參數(shù)資料
型號(hào)： ICS87993AYIT
元件分類： 時(shí)鐘及定時(shí)
英文描述： 87993 SERIES, PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32
封裝： 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32
文件頁數(shù)： 16/16頁
文件大?。?/td> 199K
代理商： ICS87993AYIT
87993AYI
www.icst.com/products/hiperclocks.html
REV. B OCTOBER 21, 2004
9
Integrated
Circuit
Systems, Inc.
ICS87993I
1-TO-5 DIFFERENTIAL-TO-3.3V LVPECL
PLL CLOCK DRIVER W/DYNAMIC CLOCK SWITCH
SCHEMATIC EXAMPLE
Figure 5A shows a schematic example of the ICS87993I. In this
example, the CLK0/nCLK0 input is selected as primary. The in-
put is driven by an LVPECL driver. Feedback can be either from
Bank A or Bank B depending on the application.The decoupling
capacitors should be physically located near the power pin.
For ICS87993I, the unused outputs can be left floating.
FIGURE 5A. ICS87993I LVPECL SCHEMATIC EXAMPLE
Zo = 50 Ohm
C3
0.1uF
R3
50
U1
ICS87993I
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
32
31
30
29
28
27
26
25
nMR
nALM_RS
CLK0
nCLK0
CLK_SEL
CLK1
nCLK1
VEE
VE
E
X
T_
FB
nEXT
_
F
B
VE
E
C
L
K_SELEC
T
ED
IN
P1BAD
IN
P0BAD
VC
C
VCC
nQB2
QB2
nQB1
QB1
nQB0
QB0
VCC
PLL
_S
EL
MA
N
_
O
V
R
VC
C
A
VC
C
QA
0
nQ
A0
QA
1
nQ
A1
R13
50
C1
0.1uF
VCC
R16
1K
R6
50
R10
50
(U1-29)
C11
0.01u
VCC
R1
50
+
-
Zo = 50
LVCMOS
Zo = 50
CLK_SEL
R11
50
VCC
C7 (Option)
0.1u
Zo = 50 Ohm
VCC
C5 (Option)
0.1u
C2
0.1uF
Zo = 50 Ohm
VCC
R9
50
C8 (Option)
0.1u
LVPECL Driv er
R2
50
VCC
(U1-24)
R12
50
(U1-17)
(U1-16)
C4
0.1uF
C6 (Option)
0.1u
LVCMOS
R5
50
LVCMOS
R7
10
LVPECL Driv er
VCCA
LVCMOS
R15
1K
R14
50
R4
50
C16
10u
R2
1K
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PDF描述
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參數(shù)描述
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