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參數(shù)資料
| 型號： | ICS93716YG-T |
| 英文描述： | Low Cost DDR Phase Lock Loop Clock Driver |
| 中文描述： | 低成本的DDR鎖相環(huán)時鐘驅(qū)動器 |
| 文件頁數(shù)： | 4/12頁 |
| 文件大?。?/td> | 89K |
| 代理商： | ICS93716YG-T |
4
ICS93716
0420E—04/01/03
Absolute Maximum Ratings
Supply Voltage (VDD & AVDD). . . . . . . . . . . -0.5V to 4.6V
Logic Inputs . . . . . . . . . . . . . . . . . . . . . . . . . GND - 0.5V to V
DD
+ 0.5V
Ambient Operating Temperature . . . . . . . . . . 0°C to +85°C
Storage Temperature. . . . . . . . . . . . . . . . . . . -65°C to +150°C
Stresses above those listed under Absolute Maximum Ratings may cause permanent damage to the device. These
ratings are stress specifications only and functional operation of the device at these or any other conditions above those
listed in the operational sections of the specifications is not implied. Exposure to absolute maximum rating conditions
for extended periods may affect product reliability.
Electrical Characteristics - Input/Supply/Common Output Parameters
T
A
= 0 - 85C; Supply Voltage AVDD, VDD = 2.5 V +/- 0.2V, R
L
= 120
, C
L
=15pF (unless otherwise stated)
PARAMETER
SYMBOL
CONDITIONS
Input High Current
I
IH
V
I
= V
DD
or GND
Input Low Current
I
IL
V
I
= V
DD
or GND
I
DD2.5
R
L
= 120
, C
L
= 0pf @ 170MHz
I
DDPD
C
L
= 0pf
Input Clamp Voltage
V
IK
V
DDQ
= 2.3V Iin = -18mA
I
OH
= -1 mA
I
OH
= -12 mA
I
OL
=1 mA
I
OL
=12 mA
Input Capacitance
1
C
IN
V
I
= GND or V
DD
Output Capacitance
1
C
OUT
V
OUT
= GND or V
DD
1
Guaranteed by design at 233MHz, not 100% tested in production.
MIN
5
TYP
MAX
UNITS
μA
μA
mA
mA
V
V
V
V
V
pF
pF
5
250
65
350
90
-1.2
V
DD
- 0.1
1.7
0.1
0.6
3
3
Operating Supply
Current
High-level output
voltage
V
OH
Low-level output voltage
V
OL
相關(guān)PDF資料 |
PDF描述 |
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| ICS93722YFLFT | Low Cost DDR Phase Lock Loop Zero Delay Buffer |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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