參數(shù)資料
型號: ICS95V850AGT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 1/10頁
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描述: IC CLK DVR PLL 1:10 48TSSOP
產(chǎn)品變化通告: Product Discontinuation 09/Dec/2011
標(biāo)準(zhǔn)包裝: 1,000
類型: 時(shí)鐘緩沖器/驅(qū)動器,多路復(fù)用器
PLL:
主要目的: 存儲器,DDR
輸入: LVCMOS,LVDS,LVPELL,LVTTL
輸出: SSTL-2
電路數(shù): 1
比率 - 輸入:輸出: 1:10
差分 - 輸入:輸出: 是/是
頻率 - 最大: 210MHz
電源電壓: 2.3 V ~ 2.7 V
工作溫度: 0°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 48-TFSOP(0.240",6.10mm 寬)
供應(yīng)商設(shè)備封裝: 48-TSSOP
包裝: 帶卷 (TR)
其它名稱: 95V850AGT
Integrated
Circuit
Systems, Inc.
ICS95V850
0458G—11/21/08
Block Diagram
DDR Phase Lock Loop Clock Driver (60MHz - 210MHz)
Pin Configuration
48-Pin TSSOP
6.10mm Body, 0.5mm Pitch
Recommended Application:
DDR Clock Driver
Product Description/Features:
Low skew, low jitter PLL clock driver
Feedback pins for input to output synchronization
Spread Spectrum tolerant inputs
With bypass mode mux
Operating frequency 60 to 210 MHz
AC Coupled (Universal) CLK inputs:
- 400 mV switching amplitude
- (LVTTL, LVPELL, LVDS, LVCMOS) standards
translation to SSTL2
Switching Characteristics:
CYCLE - CYCLE jitter: <60ps
OUTPUT - OUTPUT skew: <60ps
Period jitter: ±30ps
DUTY CYCLE: 49.5% - 50.5%
Functionality
S
T
U
P
N
IS
T
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P
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CLKT1
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CLKT2
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CLK_INT
CLK_INC
AVDD
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CLKC3
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CLKT4
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GND
NC
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CLKC5
CLKT5
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CLKT6
CLKC6
GND
CLKC7
CLKT7
VDD
FB_INC
VDD
FB_OUTT
GND
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CLKT9
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FB_OUTC
ICS95V850
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PLL
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FB_INC
CLK_INC
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CLKC7
CLKC8
CLKC9
AVDD
相關(guān)PDF資料
PDF描述
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ICS97ULP877BKLFT IC CLOCK DRIVER 1.8V LP 40VFQFPN
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參數(shù)描述
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