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參數(shù)資料
| 型號： | ICS9DB106YG-T |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 9DB SERIES, PLL BASED CLOCK DRIVER, 3 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28 |
| 封裝： | 4.40 MM, 0.65 MM PITCH, MO-153, TSSOP-28 |
| 文件頁數(shù)： | 3/14頁 |
| 文件大?。?/td> | 164K |
| 代理商： | ICS9DB106YG-T |
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Home > Products > PC Clocks > Clock Buffers > 9DB106
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9DB106 (Clock Buffers)
Description
1-to-6 Zero-delay or fanout buffer for PCI Express. The ICS9DB106 zero-delay buffer supports PCI Express clocking requirements. The
ICS9DB106 is driven by a differential SRC output pair from an ICS CK409/CK410-compliant main clock generator such as the ICS952601 or
ICS954101. It attenuates jitter on the input clock and has a selectable PLL bandwidth to maximize performance in systems with or without Spread-
Spectrum clocking.
Market Group
PC CLOCK
Additional Info
Output Features 6 - 0.7V current mode differential output pairs (HSCL) SMBus for complete device control 28-pin SSOP, TSSOP
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Attributes
9DB106BFLF
9DB106BFLFT
9DB106BGLF
9DB106BGLFT
9DB106CFLF
9DB106CFLFT
Package
SSOP 28 (PYG28)
TSSOP 28 (PGG28)
SSOP 28 (PYG28)
Speed
NA
Temperature
C
Voltage
3.3 V
Status
Active
Obsolete
Sample
Yes
No
Yes
No
Yes
No
Minimum Order
Quantity
188
1500
192
2000
188
1500
Factory Order
Increment
47
1500
48
2000
47
1500
2
1
2
1
Related Documents
Type
Title
Size
Revision Date
Datasheet
9DB106 Datasheet
115 KB
03/19/2007
Page 1 of 2
08-Jun-2007
mhtml:file://C:\9DB106.mht
相關PDF資料 |
PDF描述 |
|---|---|
| ICS9DB106YGLFT | 9DB SERIES, PLL BASED CLOCK DRIVER, 3 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28 |
| ICS9DB106YFLFT | 9DB SERIES, PLL BASED CLOCK DRIVER, 3 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28 |
| ICS9DB108YGLFT | 9DB SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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