參數(shù)資料
型號(hào): ICS9DB106YGLFT
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時(shí)鐘及定時(shí)
英文描述: 9DB SERIES, PLL BASED CLOCK DRIVER, 3 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
封裝: 4.40 MM, 0.65 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-28
文件頁(yè)數(shù): 13/14頁(yè)
文件大?。?/td> 189K
代理商: ICS9DB106YGLFT
IDTTM/ICSTM 6 Output PCI Express* Buffer with CLKREQ# Function
ICS9DB106
REV E 08/06/07
ICS9DB106
6 Output PCI Express* Buffer with CLKREQ# Function
8
Alternative termination for LVDS and other common differential signals. Figure 3.
Vdiff
Vp-p
Vcm
R1
R2
R3
R4
Note
0.45 v
0.22v
1.08
33
150
100
0.58
0.28
0.3
0.6
33
78.7
137
100
0.80
0.40
0.6
33
78.7
none
100
ICS874003i-02 input compatible
0.60
1.2
33
174
140
100
Standard LVDS
R1a = R1b = R1
R2a = R2b = R2
Cable connected AC coupled application, figure 4
Component
Value
Note
R5a,R5b
5%
R6a,R6b
Cc
0.1
0.350
Vcm
volts
Figure_3.
R1b
R1a
R2a
R2b
HSCL Output
Buffer
Down Device
REF_CLK Input
L1
L2
L3’
L4
L1’
L2’
L3
L4’
R3
R4
Figure_4.
PCIe Device
REF_CLK Input
L4
L4’
R6b
R5b
R6a
R5a
3.3 Volts
Cc
8.2K
5%
uF
1K
相關(guān)PDF資料
PDF描述
ICS9DB106YFLFT 9DB SERIES, PLL BASED CLOCK DRIVER, 3 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
ICS9DB108YGLFT 9DB SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
ICS9DB108YFT 9DB SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
ICS9DB108YGT 9DB SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
ICS9DB108YGLFT 9DB SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
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參數(shù)描述
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