參數(shù)資料
型號： ICS9DB108YFLFT
英文描述： Eight Output Differential Buffer for PCI-Express
中文描述： 8個輸出差分緩沖器支持PCI - Express
文件頁數(shù)： 2/15頁
文件大?。?/td> 109K
代理商： ICS9DB108YFLFT
2
Integrated
Circuit
Systems, Inc.
ICS9DB108
0723D—01/08/04
Pin Description
PIN #
PIN NAME
PIN TYPE
DESCRIPTION
1
SRC_DIV#
IN
Active low Input for determining SRC output frequency SRC or
SRC/2.
0 = SRC/2, 1= SRC
Power supply, nominal 3.3V
Ground pin.
0.7 V Differential SRC TRUE input
0.7 V Differential SRC COMPLEMENTARY input
Active high input for enabling outputs.
0 = tri-state outputs, 1= enable outputs
Active high input for enabling outputs.
0 = tri-state outputs, 1= enable outputs
0.7V differential true clock outputs
0.7V differential complement clock outputs
Ground pin.
Power supply, nominal 3.3V
0.7V differential true clock outputs
0.7V differential complement clock outputs
Active high input for enabling outputs.
0 = tri-state outputs, 1= enable outputs
Active high input for enabling outputs.
0 = tri-state outputs, 1= enable outputs
0.7V differential true clock outputs
0.7V differential complement clock outputs
Ground pin.
Power supply, nominal 3.3V
0.7V differential true clock outputs
0.7V differential complement clock outputs
Input to select Bypass(fan-out) or PLL (ZDB) mode
0 = Bypass mode, 1= PLL mode
Clock pin of SMBus circuitry, 5V tolerant.
Data pin for SMBus circuitry, 5V tolerant.
2
3
4
5
VDD
GND
SRC_IN
SRC_IN#
PWR
PWR
IN
IN
6
OE_0
IN
7
OE_3
IN
8
9
10
11
12
13
DIF_0
DIF_0#
GND
VDD
DIF_1
DIF_1#
OUT
OUT
PWR
PWR
OUT
OUT
14
OE_1
IN
15
OE_2
IN
16
17
18
19
20
21
DIF_2
DIF_2#
GND
VDD
DIF_3
DIF_3#
OUT
OUT
PWR
PWR
OUT
OUT
22
BYPASS#/PLL
IN
23
24
SCLK
SDATA
IN
I/O
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PDF描述
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