參數(shù)資料
型號: ICS9FG110
英文描述: Programmable FTG for Differential PCI-Express
中文描述: 可編程FTG微分的PCI - Express
文件頁數(shù): 1/1頁
文件大?。?/td> 20K
代理商: ICS9FG110
Integrated
Circuit
Systems, Inc.
ICS9FG110
Advance Information
0872—12/11/03
Pin Configuration
Recommended Application:
Frequency Timing Generator for Differential PCI-Express clocks
Features:
Generates common PCI-Express frequencies from
reference input clock (33.33MHz)
7 - 0.7V current-mode differential output pairs
Three spread spectrum modes: spread tracking mode, 0
to -0.5 downspread and +/-0.25% centerspread
Support for M/N programming
Programmable spread percentage
Programmable output divider
SMBus address is DC/DD
Key Specifications:
Output cycle-to-cycle jitter < 85 ps
Output to output skew < 85 ps
+/-300 ppm frequency accuracy on output clocks
Programmable FTG for Differential PCI-Express
ADVANCE INFORMATION
documents contain information on products in the formative or design phase development. Characteristic data and other specifications are design goals.
ICS reserves the right to change or discontinue these products without notice. Third party brands and names are the property of their respective owners.
Power Groups
REFIN 1
SDATA 2
SCLK 3
*PD# 4
PCIEXT0 5
PCIEXC0 6
VDDPCIEX 7
GND 8
PCIEXT1 9
PCIEXC1 10
PCIEXT2 11
PCIEXC2 12
PCIEXT3 13
PCIEXC3 14
28 VDDA
27 GNDA
26 IREF
25 MODE_SEL**
24 PCIEXT6
23 PCIEXC6
22 VDDPCIEX
21 GND
20 PCIEXT5
19 PCIEXC5
18 PCIEXT4
17 PCIEXC4
16 VDDPCIEX
15 GND
28-SSOP/TSSOP
* This pin have 120K pull-up to VDD
I
** This pin have 120K pull-down to GND
VDD
GND
28
27
Analog pow er & GND for CPU Core
7, 22
8, 15, 21
Pow er & GND for PCI Express Clock
Outputs
Pin Number
Description
Block Diagram
I REF
Programmable
Spread
PLL1
Programmable
Frequency
Dividers
REFIN
SDATA
SCLK
MODE_SEL
Control
Logic
PCIEXC (6:0)
PCIEXT (6:0)
Functionality Table
MODE_SEL
0
1
Spread Spectrum %
Spread Tracking Input
+/- 0.25 Center Spread
PCIEX Freq
100
100
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PDF描述
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參數(shù)描述
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