IDTTM Frequency Gearing Clock for CPU, PCIe Gen1 & FBD 1386A - 02/02/10 9FG1901H Frequency Gearing C" />
參數(shù)資料
型號(hào): ICS9FG1901HKLFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 13/18頁
文件大?。?/td> 0K
描述: IC FREQUENCY GENERATOR 72-QFN
標(biāo)準(zhǔn)包裝: 1
系列: PCI Express® (PCIe)
類型: 時(shí)鐘/頻率發(fā)生器
PLL:
主要目的: 存儲(chǔ)器,DIMM,PCI Express(PCIe)
輸入: HCSL
輸出: HCSL
電路數(shù): 1
比率 - 輸入:輸出: 1:19
差分 - 輸入:輸出: 是/是
頻率 - 最大: 400MHz
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 72-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝: 72-VFQFPN(10x10)
包裝: 標(biāo)準(zhǔn)包裝
產(chǎn)品目錄頁面: 1251 (CN2011-ZH PDF)
其它名稱: 800-1264-6
IDTTM
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
1386A - 02/02/10
9FG1901H
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
4
Pin Description (continued)
PIN #
PIN NAME
PIN TYPE
DESCRIPTION
37
OE9#
IN
Active low input for enabling DIF pair 9.
1 = tri-state outputs, 0 = enable outputs
38
DIF_9
OUT
0.7V differential true clock output
39
DIF_9#
OUT
0.7V differential complement clock output
40
OE10#
IN
Active low input for enabling DIF pair 10.
1 = tri-state outputs, 0 = enable outputs
41
DIF_10
OUT
0.7V differential true clock output
42
DIF_10#
OUT
0.7V differential complement clock output
43
OE11#
IN
Active low input for enabling DIF pair 11.
1 = tri-state outputs, 0 = enable outputs
44
DIF_11
OUT
0.7V differential true clock output
45
DIF_11#
OUT
0.7V differential complement clock output
46
GND
PWR
Ground pin.
47
VDD
PWR
Power supply, nominal 3.3V
48
OE12#
IN
Active low input for enabling DIF pair 12.
1 = tri-state outputs, 0 = enable outputs
49
DIF_12
OUT
0.7V differential true clock output
50
DIF_12#
OUT
0.7V differential complement clock output
51
OE13#
IN
Active low input for enabling DIF pair 13.
1 = tri-state outputs, 0 = enable outputs
52
DIF_13
OUT
0.7V differential true clock output
53
DIF_13#
OUT
0.7V differential complement clock output
54
OE14#
IN
Active low input for enabling DIF pair 14.
1 = tri-state outputs, 0 = enable outputs
55
DIF_14
OUT
0.7V differential true clock output
56
DIF_14#
OUT
0.7V differential complement clock output
57
OE15#
IN
Active low input for enabling DIF pair 15.
1 = tri-state outputs, 0 = enable outputs
58
DIF_15
OUT
0.7V differential true clock output
59
DIF_15#
OUT
0.7V differential complement clock output
60
OE16#
IN
Active low input for enabling DIF pair 16.
1 = tri-state outputs, 0 = enable outputs
61
DIF_16
OUT
0.7V differential true clock output
62
DIF_16#
OUT
0.7V differential complement clock output
63
VDD
PWR
Power supply, nominal 3.3V
64
GND
PWR
Ground pin.
65
DIF_17
OUT
0.7V differential true clock output
66
DIF_17#
OUT
0.7V differential complement clock output
67
DIF_18
OUT
0.7V differential true clock output
68
DIF_18#
OUT
0.7V differential complement clock output
69
OE17_18#
IN
Active low input for enabling DIF pairs 17 and 18.
1 = tri-state outputs, 0 = enable outputs
70
CLK_IN
IN
True Input for differential reference clock.
71
CLK_IN#
IN
Complement Input for differential reference clock.
72
SMB_A2_PLLBYP#
IN
SMBus address bit 2. When Low, the part operates as a fanout buffer with the
PLL bypassed. When High, the part operates as a zero-delay buffer (ZDB) with
the PLL operating.
0 = fanout mode (PLL bypassed), 1 = ZDB mode (PLL used)
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PDF描述
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參數(shù)描述
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ICS9FG1903AK-1LFT 功能描述:IC BUFFER PCIE 3.3V 72-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器,PLL,頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:2,000 系列:- 類型:PLL 時(shí)鐘發(fā)生器 PLL:帶旁路 輸入:LVCMOS,LVPECL 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:2:11 差分 - 輸入:輸出:是/無 頻率 - 最大:240MHz 除法器/乘法器:是/無 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應(yīng)商設(shè)備封裝:32-TQFP(7x7) 包裝:帶卷 (TR)
ICS9FG1903AKLF 功能描述:IC BUFFER PCIE 3.3V 72-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器,PLL,頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 類型:時(shí)鐘/頻率合成器,扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:56-VFQFP-EP(8x8) 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT