- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄1923 > IDT5V5201DCGI (IDT, Integrated Device Technology Inc)TXRX 1CH M-LVDS TO LVTTL 8-SOIC PDF資料下載
參數(shù)資料
| 型號： | IDT5V5201DCGI |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 9/18頁 |
| 文件大?。?/td> | 0K |
| 描述： | TXRX 1CH M-LVDS TO LVTTL 8-SOIC |
| 標準包裝： | 97 |
| 類型： | 收發(fā)器 |
| 驅(qū)動器/接收器數(shù)： | 1/1 |
| 規(guī)程： | LVDS |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應商設備封裝： | 8-SOIC |
| 包裝： | 管件 |
| 其它名稱： | 5V5201DCGI |
Electrical Specification
17
May 18, 2006
IDT5V5201
Single Channel Type-1 M-LVDS to LVTTL Transceiver
Figure-10 Timing and Voltage Definitions for the Output Signal
Table-10 M-LVDS Type-1 Receiver AC Parameters
Output mode
Symbol
Parameter
Test Condition
Min
Typ
Max
Unit
LVTTL
tpLH
Delay, Low to High Level
Input clock: freq = 50 MHz, Impedance
= 150
, Voltage = -200 mV - 200 mV.
See Figure-3
2.5
5.5
6.5
ns
tpHL
Delay, High to Low Level
2.5
5.5
6.5
ns
tsk
Type-1
Pulse Skew, tsk = |tpLH - tpHL|
100
300
ps
Tr (10% - 90%)
Rise Time
1
2.4
ns
Tf (10% - 90%)
Fall Time
1
2.4
ns
Tjit(per)
Period jitter, rms(1 standard deviation)
4
7
ps
Output to Output Skew
200
ps
Table-11 M-LVDS Driver AC Parameter
Symbol
Parameter
Test Condition
Min
Typ
Max
Unit
tpLH
Delay, Low to High Level
Input clock: freq = 15 MHz, Tr = Tf = 1.2 ns,
Impedance = 300
, Voltage = 0 V - 3.3 V. See
2.5
3.7
5.5
ns
tpHL
Delay, High to Low Level
2.5
3.7
5.5
ns
Tsk
LVTTL input
Pulse Skew, tsk = |tpLH - tpHL|
40
100
ps
Tr (10% - 90%)
Rise Time
0.7
1.1
1.5
ns
Tf (10% - 90%)
Fall Time
0.7
1.1
1.5
ns
Tjit(per)
Period jitter, rms(1 standard deviation)
2
3
ps
Output to Output Skew
100
ps
Input
t
pLH
t
pHL
Output
V
s
0.8V
s/0.9Vs
0.2V
s/0.1Vs
0 V
s
t
f
t
r
相關PDF資料 |
PDF描述 |
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