參數(shù)資料
型號(hào)： IDT7016L25JB
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： Quad Low-Power JFET-Input Operational Amplifier 14-PDIP 0 to 70
中文描述： 16K X 9 DUAL-PORT SRAM, 25 ns, PQCC68
封裝： PLASTIC, LCC-68
文件頁(yè)數(shù)： 11/20頁(yè)
文件大小： 262K
代理商： IDT7016L25JB
IDT7016S/L
HIGH-SPEED 16K x 9 DUAL-PORT STATIC RAM
MILITARY AND COMMERCIAL TEMPERATURE RANGES
6.13
11
TIMING WAVEFORM OF SEMAPHORE READ AFTER WRITE TIMING, EITHER SIDE
(1)
NOTES:
1. D
OR
= D
OL
=V
IH
,
CE
R
=
CE
L
=V
IH
.
2. All timing is the same for left and right ports. Port“A” may be either left or right port. “B” is the opposite port from “A”.
3. This parameter is measured from R/
W
A
or
SEM
"A"
going high to R/
W
"B"
or
SEM
"B"
going High.
4. If t
SPS
is not satisfied, there is no guarantee which side will be granted the semaphore flag.
TIMING WAVEFORM OF SEMAPHORE WRITE CONTENTION
(1,3,4)
SEM
"A"
3190 drw 12
t
SPS
MATCH
R/
W
"A"
MATCH
A
0"A"
-A
2
"A"
SIDE
"A"
(2)
SEM
"B"
R/
W
"B"
SIDE
"B"
(2)
A
0"B"
-A
2
"B"
NOTES:
1.
CE
= V
IH
for the duration of the above timing (both write and read cycle).
2. "DATA
OUT
VALID" represents all I/O's (I/O
0
-I/O
8
) equal to the semaphore value.
SEM
3190 drw 11
t
AW
t
EW
t
SOP
I/O
0
VALID ADDRESS
t
SAA
R/
W
t
WR
t
OH
t
ACE
VALID ADDRESS
DATA
IN
VALID
DATA
OUT
VALID
(2)
t
DW
t
WP
t
DH
t
AS
t
SWRD
t
AOE
Read Cycle
Write Cycle
A
0
-A
2
OE
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PDF描述
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