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參數(shù)資料
| 型號： | IDT7025S55GB |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | HIGH-SPEED 8K x 16 DUAL-PORT STATIC RAM |
| 中文描述： | 8K X 16 DUAL-PORT SRAM, 55 ns, CPGA84 |
| 封裝： | CERAMIC, PGA-84 |
| 文件頁數(shù)： | 8/20頁 |
| 文件大?。?/td> | 294K |
| 代理商： | IDT7025S55GB |
6.16
8
IDT7025S/L
HIGH-SPEED 8K x 16 DUAL-PORT STATIC RAM
MILITARY AND COMMERCIAL TEMPERATURE RANGES
NOTES:
1. Timing depends on which signal is asserted last,
OE
,
CE
,
LB
, or
UB
.
2. Timing depends on which signal is de-asserted first,
CE
,
OE
,
LB
, or
UB
.
3. t
BDD
delay is required only in case where opposite port is completing a write operation to the same address location for simultaneous read operations
BUSY
has no relation to valid output data.
4. Start of valid data depends on which timing becomes effective last
t
ABE
,
t
AOE
,
t
ACE
,
t
AA
or t
BDD
.
5.
SEM
= V
IH
.
WAVEFORM OF READ CYCLES
(5)
TIMING OF POWER-UP POWER-DOWN
t
RC
R/
W
CE
ADDR
t
AA
t
ACE(4)
OE
UB
,
LB
2683 drw 07
(4)
t
AOE(4)
t
ABE(4)
(1)
t
LZ
t
OH
(2)
t
HZ
(3, 4)
t
BDD
DATA
OUT
BUSY
OUT
VALID DATA
(4)
CE
2683 drw 08
t
PU
I
CC
I
SB
t
PD
50%
50%
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT7025S55J | HIGH-SPEED 8K x 16 DUAL-PORT STATIC RAM |
| IDT7025S55PF | HIGH-SPEED 8K x 16 DUAL-PORT STATIC RAM |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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