參數(shù)資料
型號: IDT70V24L25PF
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: DRAM
英文描述: HIGH-SPEED 3.3V 4K x 16 DUAL-PORT STATIC RAM
中文描述: 4K X 16 DUAL-PORT SRAM, 25 ns, PQFP100
封裝: 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, TQFP-100
文件頁數(shù): 12/17頁
文件大?。?/td> 281K
代理商: IDT70V24L25PF
6.38
12
IDT70V24S/L
HIGH-SPEED 3.3V 4K x 16 DUAL-PORT STATIC RAM
COMMERCIAL TEMPERATURE RANGE
AC ELECTRICAL CHARACTERISTICS OVER THE
OPERATING TEMPERATURE AND SUPPLY VOLTAGE RANGE
(1)
IDT70V24X25
IDT70V24X35
IDT70V24X55
Symbol
INTERRUPT TIMING
t
AS
t
WR
t
INS
t
INR
NOTE:
1. "X" in part numbers indicates power rating (S or L).
WAVEFORM OF INTERRUPT TIMING
(1)
Parameter
Min.
Max.
Min.
Max.
Min.
Max.
Unit
Address Set-up Time
Write Recovery Time
Interrupt Set Time
Interrupt Reset Time
0
0
25
30
0
0
30
35
0
0
40
45
ns
ns
ns
ns
2911 tbl 14
TRUTH TABLE III — INTERRUPT FLAG
(1)
Left Port
R/
W
L
CE
L
OE
L
A
11L
-A
0L
INT
L
L
X
X
X
X
X
X
X
X
L
L
Right Port
OE
R
L
R/
W
R
X
X
L
X
CE
R
A
11R
-A
0R
INT
X
FFF
FFE
X
R
L
(2)
H
(3)
X
X
Function
FFF
X
X
FFE
X
X
X
L
L
X
X
L
X
X
Set Right
INT
R
Flag
Reset Right
INT
R
Flag
Set Left
INT
L
Flag
Reset Left
INT
L
Flag
L
(3)
H
(2)
NOTES:
1. Assumes
BUSY
L
=
BUSY
R
= V
IH
.
2. If
BUSY
L
= V
IL
, then no change.
3. If
BUSY
R
= V
IL
, then no change.
2911 tbl 15
TRUTH TABLES
2911 drw 16
ADDR
"A"
INTERRUPT SET ADDRESS
CE
"A"
R/
W
"A"
t
AS
t
WC
t
WR
(3)
(4)
t
INS(3)
INT
"B"
(2)
2911 drw 17
ADDR
"B"
INTERRUPT CLEAR ADDRESS
CE
"B"
OE
"B"
t
AS
t
RC
(3)
t
INR(3)
INT
"B"
(2)
NOTES:
1. All timing is the same for left and right ports. Port “A” may be either the left or right port. Port “B” is the port opposite from “A”.
2. See Interrupt truth table.
3. Timing depends on which enable signal (
CE
or R/
W
) is asserted last.
4. Timing depends on which enable signal (
CE
or R/
W
) is de-asserted first.
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PDF描述
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IDT70V24L55G HIGH-SPEED 3.3V 4K x 16 DUAL-PORT STATIC RAM
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