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參數(shù)資料
| 型號： | IDT70V25S25G |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | HIGH-SPEED 3.3V 8K x 16 DUAL-PORT STATIC RAM |
| 中文描述： | 8K X 16 DUAL-PORT SRAM, 25 ns, CPGA84 |
| 封裝： | 1.120 X 1.120 INCH, 0.160 INCH HEIGHT, CERAMIC, PGA-84 |
| 文件頁數(shù)： | 9/17頁 |
| 文件大小： | 276K |
| 代理商： | IDT70V25S25G |
6.39
9
IDT70V25S/L
HIGH-SPEED 3.3V 8K x 16 DUAL-PORT STATIC RAM
COMMERCIAL TEMPERATURE RANGE
TIMING WAVEFORM OF SEMAPHORE READ AFTER WRITE TIMING, EITHER SIDE
(1)
TIMING WAVEFORM OF SEMAPHORE WRITE CONTENTION
(1,3,4)
NOTES:
1. D
OR
= D
OL
= V
IL
,
CE
R
=
CE
L
= V
IH
, or both
UB
&
LB
= V
IH
.
2. All timing is the same for left and right port. Port “A” may be either left or right port. Port “B” is the opposite from port “A”.
3. This parameter is measured from R/
W"
A"
or
SEM"
A"
going High to R/
W"
B"
or
SEM"
B"
going High.
4. If t
SPS
is not satisfied, there is no guarantee which side will be granted the semaphore flag.
NOTES:
1.
CE
= V
IH
or
UB
&
LB
= V
IH
for the duration of the above timing (both write and read cycle).
2. "DATA
OUT
VALID" represents all I/O's (I/O
0
-I/O
15
) equal to the semaphore value.
SEM
"A"
2944 drw 11
t
SPS
MATCH
R/
W
"A"
MATCH
A
0"A"
-A
2"A"
SIDE
“A”
(2)
SEM
"B"
R/
W
"B"
A
0"B"
-A
2"B"
SIDE
(2)
“B”
SEM
2944 drw 10
t
AW
t
EW
t
SOP
I/O
0
VALID ADDRESS
t
SAA
R/
W
t
WR
t
OH
t
ACE
VALID ADDRESS
DATA
IN
VALID
DATA
OUT
VALID
(2)
t
DW
t
WP
t
DH
t
AS
t
SWRD
t
AOE
Read Cycle
Write Cycle
A
0
-A
2
OE
相關PDF資料 |
PDF描述 |
|---|---|
| IDT70V25L35G | HIGH-SPEED 3.3V 8K x 16 DUAL-PORT STATIC RAM |
| IDT70V25L55G | HIGH-SPEED 3.3V 8K x 16 DUAL-PORT STATIC RAM |
| IDT70V25S25J | HIGH-SPEED 3.3V 8K x 16 DUAL-PORT STATIC RAM |
| IDT70V25S25PF | HIGH-SPEED 3.3V 8K x 16 DUAL-PORT STATIC RAM |
| IDT70V25S35G | Hazard Warning Lamp |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| IDT70V25S25PFGI | 制造商:Integrated Device Technology Inc 功能描述:IC SRAM 128KBIT 25NS 100TQFP |
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