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參數(shù)資料
| 型號： | IDT72210L25TP |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | CMOS SyncFIFOO 64 x 8, 256 x 8, 512 x 8, 1024 x 8, 2048 x 8 and 4096 x 8 |
| 中文描述： | 512 X 8 OTHER FIFO, 15 ns, PDIP28 |
| 封裝： | 0.300 INCH, THIN, PLASTIC, DIP-28 |
| 文件頁數(shù)： | 14/16頁 |
| 文件大小： | 163K |
| 代理商： | IDT72210L25TP |
5.12
14
IDT72420/72200/72210/72220/72230/72240 CMOS SyncFIFO
64 X 8, 256 X 8, 512 X 8, 1024 X 8, 2048 X 8 and 4096 X 8
MILITARY AND COMMERCIAL TEMPERATURE RANGES
NOTES:
1. t
SKEW2
is the minimum time between a rising WCLK edge and a rising RCLK edge for
AE
to change during the curent clock cycle. If the time between
the rising edge of WCLK and the rising edge of RCLK is less than t
SKEW2
, then
AE
may not change state until the next RCLK edge.
2. If a read is performed on this rising edge of the read clock, there will be Empty - 6 words in the FIFO when
AE
goes LOW.
Figure 9. Almost Empty Flag Timing
WCLK
WEN
t
ENS
AE
t
ENH
t
CLKH
t
CLKL
t
AE
RCLK
REN
t
ENS
t
ENH
(1)
t
SKEW2
Empty+7
Empty+8
(2)
t
AE
2680 drw 11
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PDF描述 |
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