參數(shù)資料
型號： IDT72255LA10TF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 14/27頁
文件大小： 0K
描述： IC FIFO 8KX18 LP 10NS 64QFP
標準包裝： 80
系列： 7200
功能： 同步
存儲容量： 144K（8K x 18）
訪問時間： 10ns
電源電壓： 4 V ~ 5.5 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 64-LQFP
供應商設備封裝： 64-TQFP（10x10）
包裝： 托盤
其它名稱： 72255LA10TF
21
IDT72255LA/72265LA CMOS SuperSync FIFO
8,192 x 18 and 16,384 x 18
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
JANUARY 13, 2009
NOTES:
1. Retransmit setup is complete after
OR returns LOW.
2. No more than D –2 words may be written to the FIFO between Reset (Master or Partial) and Retransmit setup. Therefore,
IR will be LOW throughout the Retransmit setup
procedure. D = 8,193 for the IDT72255LA and 16,385 for the IDT72265LA.
3.
OE = LOW
4. W1, W2, W3 = first, second and third words written to the FIFO after Master Reset.
5.
OR goes LOW at 60 ns + 2 RCLK cycles + tREF.
Figure 12. Retransmit Timing (FWFT Mode)
Figure 13. Serial Loading of Programmable Flag Registers (IDT Standard and FWFT Modes)
tREF
tRTS
tENH
4670 drw15
tENS
Wx
WCLK
RCLK
REN
RT
OR
PAF
HF
PAE
Q0 - Qn
tSKEW4
12
1
tPAF
tHF
tPAE
tREF
Wx+1
2
W2
tENH
tRTS
WEN
tENS
W1
tENH
(4)
(5)
3
4
tENH
W3
tA
NOTE:
1. X = 12 for the IDT72255LA and X = 13 for the IDT72265LA.
WCLK
SI
4670 drw 16
tENH
tENS
tLDS
tDS
BIT 0
EMPTY OFFSET
BIT X
BIT 0
FULL OFFSET
(1)
tENH
BIT X
(1)
tLDH
tDH
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PDF描述
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參數(shù)描述
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IDT72255LA10TFG8 功能描述:IC FIFO 8KX18 LP 10NS 64QFP RoHS:是 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標準包裝:90 系列:7200 功能:同步 存儲容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應商設備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
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