Figure 7. t
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參數(shù)資料
型號: IDT72401L15P
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 7/9頁
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描述: IC FIFO PAR 64X4 15NS 16-DIP
標(biāo)準包裝: 25
系列: 7200
功能: 異步
存儲容量: 256(64 x 4)
數(shù)據(jù)速率: 15MHz
訪問時間: 15ns
電源電壓: 4.5 V ~ 5.5 V
工作溫度: 0°C ~ 70°C
安裝類型: 通孔
封裝/外殼: 16-DIP(0.300",7.62mm)
供應(yīng)商設(shè)備封裝: 16-PDIP
包裝: 管件
其它名稱: 72401L15P
7
IDT72401/72403
CMOS PARALLEL FIFO 64 x 4, 64 x 5
MILITARY AND COMMERCIAL
TEMPERATURE RANGES
JUNE 29, 2012
Figure 7. tPT and tOPH Specification
Figure 8. Master Reset Timing
Figure 9. Output Enable Timing, IDT72403 Only
NOTE:
1. High-Z transitions are referenced to the steady-state VOH –500mV and VOL +500mV levels on the output. tHZOE is tested with 5pF load capacitance instead of 30pF as
shown in Figure 1.
2747 drw 14
IR
SI
Q0
SO
OR
MR
D0
D1
D2
D3
IR
SI
Q0
Q1
Q2
Q3
SO
OR
MR
SHIFT IN
INPUT READY
DATA IN
MR
OUTPUT READY
SHIFT OUT
DATA OUT
Q1
Q2
Q3
D0
D1
D2
D3
NOTE:
1. FIFOs can be easily cascaded to any desired path. The handshaking and associated timing between the FIFOs are handled by the inherent timing of the devices.
Figure 10. 128 x 4 Depth Expansion
SI
SO
OR
(1)
tOPH
tPT
2747 drw 11
DATA OUTPUT
DATA VALID
tSOR
HZOE
t
2747 drw 13
OE
DATA OUT
tOOE
NOTE:
1. FIFO initially empty.
MR
IR
OR
tMRW
2747 drw 12
SI
DATA OUTPUT
tMRIRH
tMRQ
(1)
tMRORL
tMRS
NOTE:
1. Worst case, FIFO initially full.
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PDF描述
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參數(shù)描述
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IDT72401L25SO 功能描述:IC FIFO PAR 64X4 25NS 16-SOIC RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準包裝:80 系列:7200 功能:同步 存儲容量:18.4K(1K x 18) 數(shù)據(jù)速率:- 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP(10x10) 包裝:托盤 其它名稱:72225LB10TF