參數(shù)資料
型號： IDT72831L15PFI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： DUAL CMOS SyncFIFO
中文描述： 2K X 9 BI-DIRECTIONAL FIFO, 10 ns, PQFP64
封裝： TQFP-64
文件頁數(shù)： 7/16頁
文件大小： 169K
代理商： IDT72831L15PFI
7
Commercial And Industrial Temperature Range
IDT72801/728211/72821/72831/72841/72851
LDA
LDB
0
WENA1
WENB1
0
WCLKA
WCLKB
OPERATION ON FIFO A
OPERATION ON FIFO B
Empty Offset (LSB)
Empty Offset (MSB)
Full Offset (LSB)
Full Offset (MSB)
0
1
No Operation
1
0
Write Into FIFO
1
1
No Operation
Figure 3. Offset Register Formats and Default Values for the A and B FIFOs
Figure 2. Writing to Offset Registers for FIFOs A and B
A read and write should not be performed simultaneously to the offset
registers.
Full Flag (
FFA
,
FFB
)
—
FFA
(
FFB
) will go LOW, inhibiting further write
operations, when Array A (B) is full. If no reads are performed after reset,
FFA
(
FFB
) will go LOW after 256 writes to the IDT72801's FIFO A (B); 512 writes
to the IDT72811's FIFO A (B); 1,024 writes to the IDT72821's FIFO A (B); 2,048
writes to the IDT72831's FIFO A (B); 4,096 writes to the IDT72841's FIFO A
(B); or 8,192 writes to the IDT72851's FIFO A (B).
FFA
(
FFB
) is synchronized with respect to the LOW-to-HIGH transition of the
Write Clock WCLKA (WCLKB).
Empty Flag (
EFA
,
EFB
)
—EFA (EFB) will go LOW, inhibiting further read
operations, when the read pointer is equal to the write pointer, indicating that
Array A (B) is empty.
EFA
(
EFB
) is synchronized with respect to the LOW-to-HIGH transition of
the Read Clock RCLKA (RCLKB).
8
7
0
Empty Offset (LSB) Reg.
Default Value 007H
8
0
Full Offset (LSB) Reg.
Default Value 007H
7
8
0
Empty Offset (LSB)
Default Value 007H
8
0
Full Offset (LSB)
Default Value 007H
72801 - DUAL 256 x 9
72811 - DUAL 512 x 9
7
7
8
0
(MSB)
0
1
0
0
8
7
0
Empty Offset (LSB) Reg.
Default Value 007H
8
0
Full Offset (LSB) Reg.
Default Value 007H
7
8
0
Empty Offset (LSB)
Default Value 007H
8
0
Full Offset (LSB)
Default Value 007H
72831 - DUAL 2,048 x 9
72851 - DUAL 8,192 x 9
7
7
8
0
8
0
(MSB)
0
2
(MSB)
0
3
8
0
8
0
(MSB)
0
2
(MSB)
0
3
8
0
8
8
(MSB)
0
1
3034 drw 04
8
0
Empty Offset (LSB)
Default Value 007H
8
0
Full Offset (LSB)
Default Value 007H
72841 - DUAL 4,096 x 9
7
7
8
0
(MSB)
0
4
8
0
(MSB)
0
4
8
0
Empty Offset (LSB)
Default Value 007H
8
0
Full Offset (LSB) Reg.
Default Value 007H
72821 - DUAL 1,024 x 9
7
7
8
0
(MSB)
0
1
8
0
(MSB)
0
1
NOTE:
1. For the purposes of this table,
WENA1
and
WENB1
= V
IH
.
2. The same selection sequence applies to reading fromthe registers.
RENA1
and
RENA2
(
RENB1
and
RENB2
) are enabled and read is performed on the LOW-to-
HIGH transition of RCLKA (RCLKB).
相關(guān)PDF資料
PDF描述
IDT72831L15TF DUAL CMOS SyncFIFO
IDT72831L15TFI DUAL CMOS SyncFIFO
IDT72831L25TF DUAL CMOS SyncFIFO
IDT72831L25TFI DUAL CMOS SyncFIFO
IDT72841L10PF DUAL CMOS SyncFIFO
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
IDT72831L15PFI8 功能描述:IC FIFO SYNC DUAL 2048X9 64-TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
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