參數(shù)資料
型號(hào): IDT72V71623BC8
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 1/28頁(yè)
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描述: IC DGTL SW 2048X2048 144-BGA
標(biāo)準(zhǔn)包裝: 1,000
系列: 72V
類(lèi)型: 多路復(fù)用器
電路: 1 x 1:16
獨(dú)立電路: 1
電壓電源: 單電源
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 144-LBGA
供應(yīng)商設(shè)備封裝: 144-CABGA(13x13)
包裝: 帶卷 (TR)
其它名稱: 72V71623BC8
1
2005
Integrated Device Technology, Inc. All rights reserved. Product specifications subject to change without notice.
DSC-5903/10
IDT72V71623
3.3 VOLT TIME SLOT INTERCHANGE
DIGITAL SWITCH WITH RATE
MATCHING
2,048 x 2,048
IDT and the IDT logo are registered trademarks of Integrated Device Technology, Inc. The ST-BUS is a trademark of Zarlink Semiconductor, Inc..
FUNCTIONAL BLOCK DIAGRAM
FEATURES:
Up to 16 serial input and output streams
Maximum 2,048 x 2,048 channel non-blocking switching
Accepts data streams at 2.048 Mb/s, 4.096 Mb/s, 8.192 Mb/s or
16.384 Mb/s
Rate matching capability: Mux/Demux mode
Output Enable Indication pins provided by dedicated pins
Per-channel Variable Delay mode for low-latency applications
Per-channel Constant Delay mode for frame integrity applica-
tions
Automatic identification of ST-BUS and GCI serial streams
Automatic frame offset delay measurement
Per-stream frame delay offset programming
Per-channel high-impedance output control
Per-channel Processor mode to allow microprocessor writes to
TXstreams
Direct microprocessor access to all internal memories
Memory block programming for quick setup
IEEE-1149.1 (JTAG) Test Port
Internal Loopback for testing
Available in 144-pin Thin Quad Flatpack (TQFP) and
144-pin Ball Grid Array (BGA) packages
Operating Temperature Range -40
°°°°°C to +85°°°°°C
3.3V I/O with 5V tolerant inputs and TTL compatible outputs
DESCRIPTION:
The IDT72V71623 has a maximum non-blocking switch capacity of
2,048x2,048channelswithdatarates at 2.048Mb/s,4.096Mb/s,8.192Mb/s
or16.384Mb/s. With16inputsand16outputs,avarietyofratecombinations
issupportedunderMux/Demuxmode, toallow forswitchingbetweenstreams
ofdifferentdatarates.
Output
MUX
Receive
Serial Data
Streams
RX0
RX1
RX2
RX3
RX4
RX5
RX6
RX7
ODE
F0i
Vcc
CS
DS
R/
W A0-A13
GND
DTA
5903 drw01
RX8
RX9
RX10
RX11
RX12
RX13
RX14
RX15
Loopback
Test Port
Data Memory
Internal
Registers
Microprocessor Interface
Timing Unit
TX0
TX1
TX2
TX3
TX4
TX5
TX6
TX7
TX8
TX9
TX10
TX11
TX12
TX13
TX14
TX15
CLK
FE/
HCLK
WFPS
TDI
TMS
TCK
TDO
TRST
RESET
OEI0
OEI1
OEI2
OEI3
OEI4
OEI5
OEI6
OEI7
OEI8
OEI9
OEI10
OEI11
OEI12
OEI13
OEI14
OEI15
Connection
Memory
Transmit
Serial Data
Streams
D0-D15
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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