參數(shù)資料
型號: IDT72V71623BC
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 5/28頁
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描述: IC DGTL SW 2048X2048 144-BGA
標(biāo)準(zhǔn)包裝: 14
系列: 72V
類型: 多路復(fù)用器
電路: 1 x 1:16
獨(dú)立電路: 1
電壓電源: 單電源
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 144-LBGA
供應(yīng)商設(shè)備封裝: 144-CABGA(13x13)
包裝: 托盤
其它名稱: 72V71623BC
13
COMMERCIAL TEMPERATURE RANGE
IDT72V71623 3.3V TIME SLOT INTERCHANGE
DIGITAL SWITCH 2,048 x 2,048
TABLE 7 — FRAME INPUT OFFSET REGISTER (FOR) BITS
NOTE:
1. n denotes an input stream number from 0 to 31.
Reset Value:
0000H for all FOR registers.
15
14
13
12
11
10
9876543210
OF32
OF31
OF30
DLE3
OF22
OF21
OF20
DLE2
OF12
OF11
OF10
DLE1
OF02
OF01
OF00
DLE0
FOR0 Register
15
14
13
12
11
10
9876543210
OF72
OF71
OF70
DLE7
OF62
OF61
OF60
DLE6
OF52
OF51
OF50
DLE5
OF42
OF41
OF40
DLE4
FOR1 Register
15
14
13
12
11
10
9876543210
OF112
OF111
OF110
DLE11
OF102
OF101
OF100
DLE10
OF92
OF91
OF90
DLE9
OF82
OF81
OF80
DLE8
FOR2 Register
15
14
13
12
11
10
9876543210
OF152
OF151
OF150
DLE15
OF142
OF141
OF140
DLE14
OF132
OF131
OF130
DLE13
OF122
OF121
OF120
DLE12
FOR3 Register
Name(1)
Description
OFn2, OFn1, OFn0
These three bits define how long the serial interface receiver takes to recognize and store bit 0 from the RX input pin: i.e., to start a new frame.
(Offset Bits 2, 1 & 0)
Theinputframeoffsetcanbeselectedto+4.5clockperiodsfromthepointwheretheexternalframepulseinputsignalisappliedtothe F0i
input of the device. See Figure 6.
DLEn
ST-BUS mode:
DLEn = 0, if clock rising edge is at the point of the bit cell.
(DataLatchEdge)
DLEn = 1, if when clock falling edge is at the of the bit cell.
GCI mode:
DLEn = 0, if clock falling edge is at the point of the bit cell.
DLEn = 1, if when clock rising edge is at the of the bit cell.
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PDF描述
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IDT72V71623DAG IC DGTL SW 2048X2048 144-TQFP
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參數(shù)描述
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