參數(shù)資料
型號(hào)： IDT74FCT162601ATPA
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 通用總線功能
英文描述： CAP 15UF 6V 20% TANT SMD-3528-12 TR-7-PL SN100% LOWESR-2500
中文描述： FCT SERIES, 18-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PDSO56
封裝： TSSOP-56
文件頁(yè)數(shù)： 5/7頁(yè)
文件大?。?/td> 116K
代理商： IDT74FCT162601ATPA
IDT74FCT16601AT/CT/ET, 162601AT/CT/ET
FAST CMOS 18-BIT UNIVERSAL BUS TRANSCEIVERS
COMMERCIAL TEMPERATURE RANGE
5.9
5
SWITCHING CHARACTERISTICS OVER OPERATING RANGE
FCT16601AT/
FCT162601AT
Min.
(2)
—
1.5
FCT16601CT/
FCT162601CT
Min.
(2)
—
1.5
FCT16601ET/
FCT162601ET
Min.
(2)
—
1.5
Symbol
f
MAX
t
PLH
t
PHL
t
PLH
t
PHL
t
PLH
t
PHL
t
PZH
t
PZL
t
PHZ
t
PLZ
t
SU
Parameter
Condition
(1)
C
L
= 50pF
R
L
= 500
Max.
150
4.9
Max.
150
4.4
Max.
150
3.8
Unit
MHz
ns
CLKAB or CLKBA frequency
(4)
Propagation Delay
Ax to Bx or Bx to Ax
Propagation Delay
LEBA to Ax, LEAB to Bx
Propagation Delay
CLKBA to Ax, CLKAB to Bx
Output Enable Time
OEBA
to Ax,
OEAB
to Bx
Output Disable Time
OEBA
to Ax,
OEAB
to Bx
Set-up Time, HIGH or LOW
Ax to CLKAB, Bx to CLKBA
Hold Time HIGH or LOW
Ax after CLKAB, Bx after CLKBA
Set-up Time HIGH or LOW Clock LOW
1.5
5.2
1.5
4.7
1.5
4.2
ns
1.5
4.7
1.5
4.5
1.5
4.2
ns
1.5
5.8
1.5
5.3
1.5
4.8
ns
1.5
6.2
1.5
5.7
1.5
5.2
ns
4.0
—
3.0
—
2.4
—
ns
t
H
0
—
0
—
0
—
ns
t
SU
1.0
—
1.0
—
1.0
—
ns
Ax to LEAB, Bx to LEBA
Hold Time, HIGH or LOW
Ax after LEAB, Bx after LEBA
Set-up Time,
CLKEN
to CLK
Hold Time,
CKLEN
after CLK
Clock HIGH
2.5
2.0
—
—
2.0
1.5
—
—
1.5
0.5
—
—
ns
ns
t
H
t
SU
t
H
2.5
0
—
—
2.5
0
—
—
2.0
0
—
—
ns
ns
t
W
LEAB or LEBA Pulse Width
HIGH
(4)
CLKAB or CLKBA Pulse Width
HIGH or LOW
(4)
t
SK
(o) Output Skew
(3)
NOTES:
1. See test circuits and waveforms.
2. Minimum limits are guaranteed but not tested on Propagation Delays.
3. Skew between any two outputs of the same package switching in the same direction. This parameter is guaranteed by design.
4. This parameter is guaranteed but not tested.
2.5
—
2.5
—
2.5
—
ns
t
W
3.0
—
3.0
—
3.0
—
ns
—
0.5
—
0.5
—
0.5
ns
3247 tbl 09
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PDF描述
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