參數(shù)資料
型號： IDT74FCT162823ATPAG8
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 5/7頁
文件大?。?/td> 0K
描述： IC REGISTER 18BIT FAST 56-TSSOP
標準包裝： 2,000
系列： 74FCT
功能： 主復(fù)位
類型： D 型
輸出類型： 三態(tài)非反相
元件數(shù)： 2
每個元件的位元數(shù)： 9
延遲時間 - 傳輸： 1.5ns
觸發(fā)器類型： 正邊沿
輸出電流高，低： 24mA，24mA
電源電壓： 3.5 V ~ 6.0 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 56-TFSOP（0.240"，6.10mm 寬）
包裝： 帶卷 (TR)
其它名稱： 74FCT162823ATPAG8
5
IDT74FCT162823AT/CT
FAST CMOS 18-BIT REGISTER
INDUSTRIALTEMPERATURERANGE
SWITCHING CHARACTERISTICS OVER OPERATING RANGE
FCT162823AT
FCT162823CT
Symbol
Parameter
Condition(1)
Min.(2)
Max.
Min.(2)
Max.
Unit
tPLH
PropagationDelay
CL = 50pF
1.5
10
1.5
4.7
ns
tPHL
xCLKx to xOx
RL = 500
Ω
CL = 300pF(4)
1.5
20
1.5
8
RL = 500
Ω
tPHL
PropagationDelay
CL = 50pF
1.5
14
1.5
4.7
ns
x
CLR to xQx
RL = 500
Ω
tPZH
OutputEnableTime
CL = 50pF
1.5
12
1.5
4.4
ns
tPZL
x
OE to xOx
RL = 500
Ω
CL = 300pF(4)
1.5
23
1.5
9
RL = 500
Ω
tPHZ
OutputDisableTime
CL = 50pF(4)
1.5
7
1.5
3.6
ns
tPLZ
x
OE to xOx
RL = 500
Ω
CL = 50pF
1.5
8
1.5
3.6
RL = 500
Ω
tSU
Set-up Time HIGH or LOW xDx to xCLK
CL = 50pF
3
—
1.5
—
ns
RL= 500
Ω
tH
Hold Time HIGH or LOW, xDx to xCLK
1.5
—
0
—
ns
tSU
Set-up Time HIGH or LOW, x
CLKEN to xCLK
3
—
2.5
—
ns
tH
Hold Time HIGH or LOW, x
CLKEN to xCLK
0
—
0
—
ns
tW
xCLK Pulse Width HIGH or LOW
6
—
3
—
ns
tW
x
CLR Pulse Width LOW
6
—
3
—
ns
tREM
Recovery Time, x
CLR to xCLK
6
—
3
—
ns
tSK(o)
Output Skew(3)
—
0.5
—
0.5
ns
NOTES:
1. See test circuit and waveforms.
2. Minimum limits are guaranteed but not tested on Propagation Delays.
3. Skew between any two outputs, of the same package, switching in the same direction. This parameter is guaranteed by design.
4. This condition is guaranteed but not tested.
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