參數(shù)資料
型號: IDT74SSTUBF32866BBFG
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 9/30頁
文件大?。?/td> 0K
描述: IC BUFFER 25BIT REG DDR2 96-BGA
標(biāo)準(zhǔn)包裝: 270
邏輯類型: 1:1、1:2 可配置寄存緩沖器
電源電壓: 1.7 V ~ 1.9 V
位數(shù): 25,14
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 96-LFBGA
供應(yīng)商設(shè)備封裝: 96-CABGA(13.5x5.5)
包裝: 托盤
產(chǎn)品目錄頁面: 1254 (CN2011-ZH PDF)
其它名稱: 74SSTUBF32866BBFG
800-1695
IDT74SSTUBF32866B
25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
COMMERCIAL TEMPERATURE GRADE
25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
17
IDT74SSTUBF32866B
7067/1
3
Register Timing
Timing Diagram for SSTUBF32866B Used as a Single Device; C0 = 0, C1 = 0, RESET Switches from L to H
NOTES:
1.After RESET is switched from LOW to HIGH, all data and PAR_IN inputs signals must be set and held low for a minimum time of tACTMAX, to avoid false
error.
2.If the data is clocked in on the n clock pulse, the QERR output signal will be generated on the n+2 clock pulse, and it will be valid on the n+3 clock pulse.
n
n+1
n+ 2
n+ 3
n+ 4
tPDM, tPDMSS
CLK to Q
tSU
CLK
D1- D25
PARIN
QERR
Data to QERR Latency
CLK to QERR
tPHL, tPLH
Q1 - Q25
tSU
tH
CSR
DCS
RESET
H, L, or X
H or L
(1)
tACT
(1)
PPO
CLK to PPO
tPD
(2)
CLK to QERR
tPHL
相關(guān)PDF資料
PDF描述
IDT74SSTUBF32868ABKG IC BUFFR 28BIT REG DDR2 176-BGA
IDT74SSTUBF32869ABKG IC BUFFER 14BIT REG DDR2 150-BGA
IDT74SSTUBH32865ABKG8 IC BUFFER 28BIT 1:2 REG 160-BGA
IDT74SSTUBH32868ABKG IC BUFFER 28BIT CONF DDR2 176BGA
IDT74SSTV16857PAG IC BUFFER 14BIT SSTL I/O 48TSSOP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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