參數(shù)資料
型號(hào)： IDT82P2281PFG
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 201/371頁(yè)
文件大?。?/td> 0K
描述： TXRX T1/E1/J1 LONG/SHORT 80-TQFP
標(biāo)準(zhǔn)包裝： 30
類型： 收發(fā)器
規(guī)程： T1，E1，J1
電源電壓： 3 V ~ 3.6 V
安裝類型： 表面貼裝
封裝/外殼： 80-LQFP
供應(yīng)商設(shè)備封裝： 80-TQFP（14x14）
包裝： 托盤(pán)
其它名稱： 800-2344
82P2281PFG
IDT82P2281PFG-ND
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IDT82P2281
SINGLE T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Functional Description
28
August 20, 2009
3.6
RECEIVE JITTER ATTENUATOR
The Receive Jitter Attenuator can be chosen to be used or not. This
selection is made by the RJA_E bit.
The Jitter Attenuator consists of a FIFO and a DPLL, as shown in
Figure 7. Jitter Attenuator
The FIFO is used as a pool to buffer the jittered input data, then the
data is clocked out of the FIFO by a de-jittered clock. The depth of the
FIFO can be 32 bits, 64 bits or 128 bits, as selected by the RJA_DP[1:0]
bits. Accordingly, the constant delay produced by the Jitter Attenuator is
16 bits, 32 bits or 64 bits. The 128-bit FIFO is used when large jitter tol-
erance is expected, while the 32-bit FIFO is used in delay sensitive
applications.
The DPLL is used to generate a de-jittered clock to clock out the
data stored in the FIFO. The DPLL can only attenuate the incoming jitter
whose frequency is above Corner Frequency (CF). The jitter whose fre-
quency is lower than the CF passes through the DPLL without any atten-
uation. In T1/J1 applications, the CF of the DPLL can be 5 Hz or 1.26
Hz, as selected by the RJA_BW bit. In E1 applications, the CF of the
DPLL can be 6.77 Hz or 0.87 Hz, as selected by the RJA_BW bit. The
lower the CF is, the longer time is needed to achieve synchronization.
If the incoming data moves faster than the outgoing data, the FIFO
will overflow. If the incoming data moves slower than the outgoing data,
the FIFO will underflow. The overflow or underflow is captured by the
RJA_IS bit. When the RJA_IS bit is ‘1’, an interrupt will be reported on
the INT pin if enabled by the RJA_IE bit.
To avoid overflow or underflow, the JA-Limit function can be
enabled by setting the RJA_LIMT bit. When the JA-Limit function is
enabled, the speed of the outgoing data will be adjusted automatically if
the FIFO is close to its full or emptiness. The criteria of speed adjust-
ment start are listed in Table 6. Though the JA-Limit function can reduce
the possibility of FIFO overflow and underflow, the quality of jitter attenu-
ation is deteriorated.
Selected by the RJITT_TEST bit, the real time interval between the
read and write pointer of the FIFO or the peak-peak interval between the
read and write pointer of the FIFO can be indicated in the RJITT[6:0]
bits. When the RJITT_TEST bit is ‘0’, the current interval between the
read and write pointer of the FIFO will be written into the RJITT[6:0] bits.
When the RJITT_TEST bit is ‘1’, the current interval will be compared
with the old one in the RJITT[6:0] bits and the larger one will be indi-
cated by the RJITT[6:0] bits.
The performance of Receive Jitter Attenuator meets the ITU-T
I.431, G.703, G.736 - 739, G.823, G.824, ETSI 300011, ETSI TBR 12/
13, AT&T TR62411, TR43802, TR-TSY 009, TR-TSY 253, TR-TRY 499
Transfer for details.
Table 6: Criteria Of Speed Adjustment Start
FIFO Depth
Criteria Of Speed Adjustment Start
32 bits
2-bit close to full or empty
64 bits
3-bit close to full or empty
128 bits
4-bit close to full or empty
FIFO
32/64/128
DPLL
Jittered Data
De-jittered Data
Jittered Clock
De-jittered Clock
write
pointer
read
pointer
Table 7: Related Bit / Register In Chapter 3.6
Bit
Register
Address (Hex)
RJA_E
Receive Jitter Attenuation Configuration
027
RJA_DP[1:0]
RJA_BW
RJA_LIMT
RJITT_TEST
RJA_IS
Interrupt Status 1
03B
RJA_IE
Interrupt Enable Control 1
034
RJITT[6:0]
Receive Jitter Measure Value Indication
039
相關(guān)PDF資料
PDF描述
VE-J12-MY-F2 CONVERTER MOD DC/DC 15V 50W
LTC2498CUHF#PBF IC ADC 24BIT 16CH 38-QFN
MS3102A24-3P CONN RCPT 7POS BOX MNT W/PINS
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EXP-0921/04/S CONN RCPT 4POS IP68 W/SOCKETS
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
IDT82P2281PFG8 功能描述:TXRX SGL T1/E1/J1 80-TQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動(dòng)器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類型:收發(fā)器 驅(qū)動(dòng)器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR)
IDT82P2281PFGBLANK 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Single T1/E1/J1 Long Haul / Short Haul Transceiver
IDT82P2281PN 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Single T1/E1/J1 Long Haul Short Haul Transceiver
IDT82P2282 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Dual T1/E1/J1 Long Haul / Short Haul Transceiver
IDT82P2282_09 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Dual T1/E1/J1 Long Haul / Short Haul Transceiver
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